[ 4 ] 論理記号と真理値表

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[ 4 ] 論理記号と真理値表

[ 4 ] 論 理 記 号 と 真 理 値 表

(c) 内 部 接 続 に 関 する 記 号

記 号 名 称 お よ び 機 能

左 側 が 状 態 1 のとき、 右 側 も 状 態 1

内 部 否 定 接 続

左 側 が 状 態 1 のとき、 右 側 は 状 態 0

内 部 ダイナミック 入 力

左 側 の 状 態 0 から 状 態 1 への 遷 移 で 右 側 は 状 態 1 になる。

内 部 入 力 ( 仮 想 入 力 )。

機 能 表 記 法 による 特 記 がない 場 合 、 入 力 は 常 に 内 部 状 態 1 となる。

内 部 出 力 ( 仮 想 出 力 )。

内 部 入 力 に 接 続 された 場 合 の 影 響 は 機 能 表 記 法 によって 表 示 する。

シュミットトリガ

ヒステリシス 特 性 をもつ。

単 安 定 素 子 (リトリガ 可 能 )

1

単 安 定 素 子 (ワンショット)

G

非 安 定 素 子

!G

スタート 信 号 に 同 期 する 非 安 定 素 子

G!

終 了 信 号 により 機 能 停 止 する 非 安 定 素 子

SRGm

CTRm

CTRDIVm

RCTRm

X/Y

MUX

DMUX または DX

Σ

P-Q

CPG

π

COMP

ALU

ROM

RAM

FIFO

I = 0

I = 1

シフトレジスタ、m = ビット 数

カウンタ、m = ビット 数 、サイクル 長 = 2 m

カウンタ、サイクル 長 = m

非 同 期 式 (リップルキャリ) カウンタ、サイクル 長 = 2 m

コーダ、コードコンバータ、DEC/BCD、BIN/OUT、BIN/7-SEG など。

マルチプレクサ/データセレクタ

デマルチプレクサ

加 算 器

減 算 器

ルックアヘッドキャリージュネレータ

乗 算 器

マグニチュードコンパレータ

算 術 演 算 回 路 (arithmetic logic unit)

リードオンリメモリ

ランダムアクセスリード/ライトメモリ

ファーストインファーストアウトメモリ

電 源 が 投 入 されると 出 力 は 状 態 0 にリセットされる。

電 源 が 投 入 されると 出 力 は 状 態 1 にリセットされる。

t 1

t 2

固 定 遅 延 素 子

入 力 が 状 態 0 から 1 に 遷 移 した 後 、t 1 時 間 遅 れて 出 力 の 状 態 が 同 様 に 遷 移 する。

また、 入 力 が 状 態 1 から 状 態 0 に 遷 移 した 後 、t 2 時 間 遅 れて 出 力 の 状 態 が 同 様 に 遷 移 する。

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