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Alle wichtigen

Alle wichtigen Ergebnisse dieser Arbeit wurden in der Whole-cell-Konfiguration erreicht. Tabelle 3.5 stellt den Verlauf bis zum Erreichen dieser Konfiguration mit dazugehörigem elektrischem Ersatzschaltbild dar. Tabelle 3.6: Verlauf des Strombildes bei einer vorgegebenen Rechteckspannung und dazugehörige Zahlenwerte bis zur Erreichung eines Gigaseals in der Whole-cell Konfiguration. Ionenkanäle werden in dieser Phase als geschlossen angenommen. (Stoelzle, 2006) 32

Je nachdem, welche Lochgröße im Chip bevorzugt wird, sind die für den Port-a- Patch verwendeten Einwegchips in unterschiedlichen Widerständen erhältlich. Hier wurden fast ausschließlich Chips mit einem Widerstand von 2 bis 3,5MOhm verwendet. Zunächst wird die Unterseite mit einem Tropfen der vorbereiteten internen, die Oberseite des Chips mit einem Tropfen der externen Lösung benetzt (siehe Abbildung 3.2). Dabei ist darauf zu achten, die Tropfen möglichst mittig über dem Loch zu platzieren. Die genaue Menge der Elektrolytlösungen kann variieren und sollte zwischen 10µl und 20µl liegen. Der benetzte Chip wird nun auf den Port-a-Patch aufgeschraubt und der Aufsatz, der als Faraday-Käfig dient, auf den Chip umschließend aufgesteckt. Jetzt kann das Sealprotokoll durchlaufen oder manuell Druck und Spannung angelegt werden und nach Erreichen des letzten Schrittes von Tabelle 3.6 mit dem Messen begonnen werden. Für die Messungen an VSOR-Chloridkanälen wurde dazu ein Messprotokoll, wie es in Abbildung 3.3 zu sehen ist, gestartet. Abbildung 3.2: Chip für den Port-a-Patch, auf den ein Tropfen externer Lösung plaziert wurde. 33

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