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Schaltungsdesign mit VHDL

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A Einführung<br />

Schnittstellenbeschreibung (Entity)<br />

ENTITY and2 IS<br />

PORT (in1,in2: IN bit; and_out: OUT bit);<br />

-- definiere Pins als Signale vom Typ "bit"<br />

END and2;<br />

Architektur (Architecture)<br />

ARCHITECTURE number_one OF and2 IS<br />

BEGIN<br />

and_out

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