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INF8500 - Intra - Automne 2009Question 5 (4 points) Synthèse ESL avec Cynthesizer (labo 1)Considérez un module SystemC avec les ports d’entrée in et valid_in, les ports de sortie out etvalid_out, et dont la fonctionnalité (son SC_CTHREAD) est donnée par le bout de code cidessous:1: int i;2: unsigned int in_data [256];3: unsigned int out_data[256];4:5: while(1) {6:7: while(valid_in.read() == false) {8:9: }10:11: for(i=0;i
INF8500 - Intra - Automne 2009a) Ajouter wait(1); à la ligne 8, après la ligne 12 et après la ligne 23.b) Envelopper le bloc de lecture (lignes 7 à 13) et le bloc d’écriture (lignes 21 à 25) chacun dansun bloc CYN_PROTOCOL.c) Remplacer unsigned int par sc_uint ou unsigned char aux lignes 2 et 3.(L’algorithme utilise seulement les 8 bits de poids faible de in_data à la ligne 17)d) Utiliser une directive CYN_LATENCY pour l’ensemble de cette boucle. Elle peut être exécutéeen moins de 256 cycles si elle est déroulée et si les tableaux in_data et out_data sontimplémentés en registres (et non en mémoire RAM).Page 18 de 21
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