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Architecture MISD - Conserve la même structure, mais les UT et les UC sont découpés en étages; - Un seul flux de données reçoit plusieurs traitement simultanément; - Il ne s'agit pas de machines multiprocesseurs, mais le <strong>para</strong>llélisme se situe au niveau plus bas (au sein même du processeur) Données Étage 1 UT Étage n UT Données Mémoire Ordres UC1 UC n Processeur Instructions
Exemple d’architecture MISD : Architecture pipeline le traitement des instructions par le processeur peut se décomposer en cinq étapes : < fetch > : recherche de la prochaine instruction à exécuter ; < decode > : décodage de l'instruction, avec calculs éventuels des adresses ; < read > : chargement des opérandes dans l'unit e d'exécution, par lecture à partir des registres ou de la mémoire ; < execute > : exécution proprement dite de l'instruction ; < write > : écriture du résultat vers les registres ou la mémoire. L’éxecution cette sequence d'instructions sur une machine pipelinee a cinq étages :
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