Architecture de base d'un processeur embarquÃ© - Moodle

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Adresse calculéeLe pipeline DLXCondition de branchementLI/DIDI/EXEX/MEMMEM/ERCP4ADDMUXRINCPRI[6:10]RI[11:15]RegistresMEM/ERABMUXMUXZéro?MémoireinstructionsBranchementprisUALDonnée à écrire enregistreMémoiredonnéesAdresseValeur chargée(DMC)MUXDonnée à écrireRI[16:31]ÉtendreImmRI[0:5] Instruction InstructionINF3610 Systèmes embarqués6Donnée à écrire enregistre
Architecture RISC (rappel)• Objectif du concepteur: équilibrer la taille des étages du pipeline.• L'accélération liée au pipeline = nombre d'étages= 5• Remarques:– La difficulté principale de la technique du pipeline est ce qu'onappelle les aléas du pipeline, en effet il existe des situations,appelées aléas de données, qui empêchent l'instruction suivante duflux d'instruction de s'exécuter au cycle d'horloge qui lui estaffecté.– 3 types aléas: structurels, données et de contrôle– Par conséquent, les aléas réduisent la performance du pipeline(accélération inférieure à 5)• Les aléas (ou dépendance) de données et de contrôle sont ceux quiaffectent l’accélération de 5 (typiquement entre 3.5 et 5 selon lastratégie)INF3610 Systèmes embarqués7
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