Mit Animation (PDF) - Digitaltechnik
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Kontrolle für die sequentielle Implementierung<br />
0<br />
ue0<br />
reset reset reset reset reset<br />
1 0 0 0 0<br />
full 1<br />
full 2<br />
◮ Ähnlich wie Shift-Register<br />
0 0 0 1<br />
full 3<br />
full 4<br />
ue1 ue2 ue3 ue4<br />
◮ Ein “Full-Bit” pro Stufe<br />
full 1: Instruction Fetch, full 2: Decode, full 3: Execute, usw.<br />
◮ Aktiviert die Clock-Enables der Register der jeweils nächsten Stufe<br />
<strong>Digitaltechnik</strong> – Kapitel 7: Ein einfacher CISC-Prozessor 49<br />
full 5
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