11. Vorlesung
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11. Vorlesung
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Buszyklen<br />
• Mit Buszyklus wird die zeitliche Abfolge von Signalen auf<br />
dem Systembus bezeichnet.<br />
• Der Bus-Master, üblicherweise die CPU, steuert die<br />
logische und zeitliche Abfolge der Signale beim<br />
Transfer.<br />
• Für jeden Buszyklus gibt es einen Bus-Master.<br />
• Beim Lesezyklus legt der Bus-Master die für das Lesen<br />
notwendigen Kontrollsignale und die Adresse am Bus<br />
an. Die adressierte Speicherzelle legt den gespeicherten<br />
Wert auf den Datenbus, der von der CPU eingelesen<br />
wird. Der Bus-Master terminiert den Zyklus.<br />
• Beim Schreibzyklus legt der Bus-Master die für das<br />
Schreiben notwendigen Kontrollsignale und die Adresse<br />
am Bus an. Die CPU gibt ein Datenwort auf dem<br />
Datenbus aus. Der Speicher übernimmt das Datenwort<br />
und schreibt es an die adressierte Speicherzelle. Der<br />
Bus-Master terminiert den Zyklus<br />
Rechnergrundlagen 8
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