Masterbaustein für EnDat 2.2 - electronic-data
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<strong>Masterbaustein</strong> <strong>für</strong> <strong>EnDat</strong> <strong>2.2</strong><br />
PRODUKTINFORMATION<br />
Geschirmtes Kabel<br />
Folgeelektronik<br />
Positionsmessgerät<br />
Versorgung<br />
Daten<br />
Takt<br />
Power<br />
RS<br />
485<br />
RS<br />
485<br />
Schnittstellenbaustein<br />
<strong>EnDat</strong> <strong>2.2</strong><br />
Parallele<br />
Schnittstelle<br />
2. parallele<br />
Schnittstelle<br />
Applikation<br />
bei sicherheitsgerichteten<br />
Anwendungen<br />
FPGA-Softmakro<br />
Standard-Master /<br />
Safety-Master<br />
Implementierung <strong>EnDat</strong> <strong>2.2</strong> – Interface<br />
• Das FPGA-Softmakro des <strong>EnDat</strong> <strong>2.2</strong> – Interfaces beschreibt den steuerungsseitigen (auch als<br />
<strong>Masterbaustein</strong> bezeichneten) Teil der Schnittstelle zwischen absoluten Positionsmessgeräten<br />
(Encodern) von HEIDENHAIN und Folgeelektroniken (Steuerungen) des Anwenders.<br />
MAZeT GmbH PI-03-128 V1.4<br />
• Die Implementierung des <strong>EnDat</strong> <strong>2.2</strong> – Interfaces als <strong>Masterbaustein</strong> ist in Form eines FPGA-<br />
Softmakros (FPGA-EDIF-Netzliste) <strong>für</strong> verschiedene FPGA-Familien vorgesehen. Der hohe<br />
Funktionsumfang des FPGA-Softmakros gewährleistet eine effektive Aufteilung der<br />
Gesamtaufgaben der Steuerung zwischen <strong>EnDat</strong>-<strong>Masterbaustein</strong> und µController.<br />
• Detaillierte Informationen zum <strong>EnDat</strong> <strong>2.2</strong>-Interface sind bei HEIDENHAIN erhältlich bzw. unter<br />
www.endat.de. Zu Informationen zum <strong>Masterbaustein</strong> wenden Sie sich bitte an die MAZeT GmbH<br />
direkt oder informieren Sie sich unter www.MAZeT.de.<br />
MAZeT GmbH Vertrieb • Göschwitzer Straße. 32 • 07745 Jena • Herr Dr. Winfried Mahler • Tel.: +49 3641 2809-24 • Fax: +49 3641 2809-12 • E-Mail: sales@mazet.de<br />
www.MAZeT.de 1 von 2
Produktinformation<br />
<strong>Masterbaustein</strong> <strong>für</strong> <strong>EnDat</strong><strong>2.2</strong><br />
Funktionsumfang des<br />
FPGA-Softmakros <strong>für</strong> <strong>EnDat</strong> <strong>2.2</strong>:<br />
• Umsetzung des <strong>EnDat</strong> <strong>2.2</strong>-Befehlssatzes<br />
• Umsetzung des <strong>EnDat</strong> 2.1-Befehlssatzes<br />
• Unterstützung der SSI-Schnittstelle*<br />
• Funktionalität geprüft mit HEIDENHAIN-<br />
Messgeräten<br />
• Unterstützt bis 16 MHz Taktfrequenz <strong>für</strong> das<br />
<strong>EnDat</strong>-Interface (bei 100 MHz Systemtakt)<br />
• Kabellaufzeitermittlung und -kompensation<br />
• Zyklische Abfrage von Positionswerten mit<br />
durchlaufendem Takt möglich*<br />
• CRC-Auswertung<br />
• Datenzugriff über 6 Bit-Adressbus und 16 Bit-<br />
Datenbus <strong>für</strong> 8 und 16 Bit µController<br />
Blockschaltbild (Master ohne Safety-Funktionen)<br />
<strong>EnDat</strong> /<br />
SSI-<br />
Interface<br />
DATA_DV<br />
DE<br />
TCLK<br />
DATA_RC<br />
DUEI<br />
/SI<br />
TST_OKT_PIN<br />
/STR<br />
/Timer<br />
Protokollmaschine<br />
<strong>EnDat</strong> und SSI<br />
Sendemodul<br />
/IR6<br />
Taktgenerator<br />
Empfangsmodul<br />
/IR7<br />
CLK/2<br />
Ablaufsteuerung<br />
Konf -Reg 1<br />
Konf -Reg 2<br />
Send -Reg<br />
Empf-Reg 1<br />
Empf-Reg 2<br />
Empf-Reg 3<br />
Test-Reg 1<br />
Test-Reg 2<br />
Stat-Reg<br />
Int-Reg<br />
ID-Reg<br />
Weitere Informationen zum „Safety-Master“:<br />
CLK<br />
/Res<br />
Parallele Schnittstelle<br />
/INT<br />
/Ready<br />
Mode16<br />
/CS<br />
/WR<br />
/RD<br />
Adressen<br />
[0:5]<br />
Daten<br />
[0:15]<br />
• Zugriff über Hardware / Software und Timer-<br />
Strobe<br />
• Zusätzliche Funktionen im „Safety-Master“:<br />
- Zwei parallele Schnittstellen <strong>für</strong> die zweikanalige<br />
Übertragung der Daten Pos1, Pos2 + Fehlerbits<br />
- Vordefinierter 4-er Zyklus <strong>für</strong> die Abfrage in<br />
Sicherheitsfunktionen (Bildung Pos1 und Pos2)<br />
- Interner Vergleich von Pos1 und Pos2<br />
- Zusätzliche Überwachungsfunktionen<br />
- Sicherheitskonzept nutzbar mit entsprechend<br />
vorbereiteten HEIDENHAIN-Messgeräten<br />
- Sicherheitskonzept nutzbar <strong>für</strong> Anwendungen mit<br />
Steuerungskategorie<br />
- SIL2 - IEC61508<br />
- PL „d“ - ISO 13849<br />
- Kategorie 3 – EN 954-1<br />
- Maßnahmenkatalog zur Implementierung des Softmakros<br />
* Anmerkung: Diese Funktionen sind bei Safety-Anwendungen nicht zugelassen.<br />
Lieferung<br />
EDIF-Netzliste<br />
FPGA-Familie<br />
Die EDIF-Netzliste gestattet die Implementierung des Designs in ein FPGA. Sie ist<br />
technologieabhängig.<br />
Mit dem Stand 3/2007 werden folgende FPGA-Familien unterstützt :<br />
A L T E R A<br />
• ACEX, Cyclone,<br />
Cyclone II, Cyclone III<br />
X I L I N X<br />
• Virtex, Virtex E , 2, 4<br />
• Spartan 2, 2E, 3, 3E<br />
Anmerkung: Den Stand der Umsetzung auf andere FPGA-Familien erfragen Sie bitte direkt bei der MAZeT GmbH.<br />
Hinweis :<br />
Die ausgelieferte EDIF-Netzliste gestattet die Implementierung des Designs in ein FPGA. Wegen der darin enthaltenen I/O-Buffer ist diese<br />
Netzliste nicht <strong>für</strong> die Einbindung von weiteren zusätzlichen Baugruppen in ein gemeinsames FPGA geeignet.<br />
MAZeT GmbH PI-03-128 V1.4<br />
Um die gemeinsame Einbindung mit weiteren Baugruppen zu ermöglichen, ist eine Netzliste ohne I/O-Buffer und ggf. mit geändertem<br />
Businterface erforderlich.<br />
Dies und ggf. weitere kundenspezifische Anpassungen, wie zum Beispiel die mehrkanalige Ausführung des <strong>EnDat</strong><strong>2.2</strong>-Interfaces in einem<br />
FPGA, werden durch MAZeT auf Anfrage gern durchgeführt.<br />
MAZeT GmbH Vertrieb • Göschwitzer Straße. 32 • 07745 Jena • Herr Dr. Winfried Mahler • Tel.: +49 3641 2809-24 • Fax: +49 3641 2809-12 • E-Mail: sales@mazet.de<br />
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