netIC Benutzerhandbuch und Design Guide - Hilscher

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Das Evaluation-Board NICEB 166/227 Die maximale Länge eines Bussegments ist von der verwendeten Baudrate abhängig. Bitte verwenden Sie nur spezielles, für PROFIBUS zugelassenes Kabel, vorzugsweise den Typ A. Baudrate in kBit/s Max. Länge 9,6 1.200 m 19,2 1.200 m 93,75 1.200 m 187,5 1.000 m 500,0 400 m 1.500,0 200 m 3.000,0 100 m 6.000,0 100 m 12.000,0 100 m Tabelle 105: PROFIBUS-DP-Segmentlänge in Abhängigkeit der Baudrate Parameter Wert Wellenwiderstand 135…165 Ω Kapazitätsbelag < 30 pF/m Schleifenwiderstand 110 Ω/km Aderndurchmesser 0,64 mm Tabelle 106: Eigenschaften für PROFIBUS-zugelassene Kabel netIC | Real-Time-Ethernet- und Feldbus-Gateways DOC080601UM21DE | Revision 21 | Deutsch | 2012-01 | Freigegeben | Öffentlich © Hilscher, 2008-2012
Serial Peripheral Interface (SPI) für netIC 167/227 14 Serial Peripheral Interface (SPI) für netIC 14.1 Prinzip Das Serial Peripheral Interface (SPI) ist ein vielseitig anwendbares Bus- System zur synchronen seriellen Kommunikation digitaler Schaltkreise basierend auf dem Master-Slave-Prinzip. Es gibt für SPI viele Einsatzmöglichkeiten. Das Serial Peripheral Interface wurde ursprünglich von Motorola entwickelt, aber es existiert keine exakte Spezifikation. Das System Microwire von National Instruments lehnt sich sehr eng an SPI an Das Prinzip des Serial Peripheral Interface besteht aus den folgenden Festlegungen: • Es gibt zwei Arten von Bus-Teilnehmern: Master und Slave • Es sind in einem SPI-Bus-System beliebig viele Slaves erlaubt. • In einem SPI-Bus-System gibt es nur einen einzigen Master. Dieser kommuniziert zu einem Zeitpunkt immer nur mit einem einzigen Slave. Er erzeugt das Zeitsignal SCK (s. u.) und wählt aus, welcher Bus- Teilnehmer zur Kommunikation angesprochen werden soll. Dies geschieht über das Chip-Select-Signal (#CS), s. u. • Jeder Slave erwartet vom Master ein Taktsignal und das Chip-Select- Signal. Immer, wenn der Slave vom Master nicht zur Kommunikation angesprochen wird, befindet sich sein Datenausgang in einem hochohmigen Zustand, um ihn vom Datenbus abzukoppeln. Auf diese Weise wird verhindert, das mehrere Slaves gleichzeitig Daten an den Master senden können, was Probleme verursachen könnte. • Es werden unterschiedliche Taktfrequenzen bis in den MHz-Bereich hinein unterstützt (beim netIC: Obergrenze 1 MHz). • Es gibt 3 gemeinsame Leitungen mit denen alle Bus-Teilnehmer verbunden sind o o o MOSI (Master Out Slave In) bzw. SDI (Serial Data In) (entspricht netIC Pin 29, SPI_MOSI) MISO (Master In Slave Out) bzw. SDO (Serial Data Out) (entspricht netIC Pin 30, SPI_MISO und dient zum Rücklesen der Daten bzw. zur Kaskadierung durch Anschluss des Eingangs des nächsten Bausteins.) SCK (Serial Clock) – ein Zeitsignal zur Synchronisation der Datenkommunikation (netIC Pin 31, SPI_CLK) o MOSI und MISO können auch multiplexed sein oder eines der beiden Signale MOSI und MISO kann gänzlich fehlen. • Es gibt zu jedem Teilnehmer eine Chip-Select-Leitung (#CS), auch manchmal als #SS (Slave Select) oder #STE (Slave Transmit Enable) bezeichnet. (Diese liegt am netIC Pin 26, SPI_CS.) Diese ist logisch 0- aktiv (active low). Wird sie an Masse gelegt (low), dann geschieht folgendes: o o Der Slave wird aktiv. Das MOSI-Signal wird überwacht. netIC | Real-Time-Ethernet- und Feldbus-Gateways DOC080601UM21DE | Revision 21 | Deutsch | 2012-01 | Freigegeben | Öffentlich © Hilscher, 2008-2012
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