Baustein-Leitfaden: Konfiguration - Altium
Baustein-Leitfaden: Konfiguration - Altium
Baustein-Leitfaden: Konfiguration - Altium
Sie wollen auch ein ePaper? Erhöhen Sie die Reichweite Ihrer Titel.
YUMPU macht aus Druck-PDFs automatisch weboptimierte ePaper, die Google liebt.
KAPITEL 2: FPGA <strong>Baustein</strong>unterstützung NANOBOARD-NB1 2004<br />
12<br />
CPLD <strong>Baustein</strong>e<br />
Xilinx ®<br />
Virtex-II Pro mit SRAM<br />
<strong>Baustein</strong>: XC2VP7-5FG456C<br />
Die Virtex ®<br />
-II Pro Familie enthält Plattform-FPGAs für Designs auf der Basis von IP<br />
Cores und kundenspezifisch angepassten Modulen. Die Familie beinhaltet Multi-<br />
Gigabit Transceiver und PowerPC CPU-Blöcke. Sie ermöglicht Komplettlösungen<br />
für Telekommunikations-, Wireless, Netzwerk-, Video- und DSP-Anwendungen.<br />
XC2VP7 Funktionen:<br />
11.088 Logikzellen in 4.928 CLB Slices<br />
Bis zu 9.856 4-Input LUTs und 9.856 Flip-Flops<br />
Block RAM (bis zu 792 Kbits) und verteiltes RAM (bis zu 154 Kbits)<br />
4 Digital Clock Manager (DLLs)<br />
16 Global Clock Multiplexer Buffers<br />
Unterstützung für 32 auswählbare I/O Standards mit schnellen oder langsamen<br />
Anstiegsgeschwindigkeiten und mehreren Ansteuer-Stärken<br />
Der <strong>Baustein</strong> enthält einen 'harten' PowerPC 405 Processor Core, der in Nexar<br />
von einer vollständigen Tool-Chain unterstützt wird (TASKING Viper Compiler,<br />
Source Level Debugger, etc) und den Einsatz dieses <strong>Baustein</strong>es in FPGA-basierten<br />
System-Designs ermöglicht.<br />
Zusätzliche Funktionen der Aufsteckplatinen:<br />
Zwei IDT71V416L Static RAM ICs - 4 Meg (256K x 16) 10ns Advanced High-<br />
Speed CMOS<br />
Ein MAX1617 SMBus Temperatursensor, der die FPGA Chip-Temperature und die<br />
interne Sensortemperatur misst<br />
Schnittstelle zu zwei der Hochgeschwindigkeits- (3.125GHz) Transceiver im<br />
Virtex-II Pro - auf jedem Transceiver-Kanal sitzen vier vergoldete SMA Coax<br />
Verbindungen am oberen Rand der Aufsteckplatine (Transceiver werden mit dem<br />
programmierbaren On-board Nanoboard-Taktgeber verwendet, der ihre<br />
Geschwindigkeit auf einen Wert zwischen 1 und 2 GHz beschränkt)<br />
Das Board enthält 8 Coax-Verbindungskabel und ein Beispielprojekt, das den<br />
Einsatz der Transceiver demonstriert.<br />
Altera ®<br />
MAX ®<br />
3000/7000 mit PLCC sockets<br />
<strong>Baustein</strong>: EPM7032AELC44-10<br />
Die CPLDs der MAX ®<br />
Familie sind <strong>Baustein</strong>e mit hoher Dichte und hoher Leistungsfähigkeit<br />
auf der Basis der MAX-Architektur der zweiten Generation von Altera.<br />
Die EEPROM-basierten <strong>Baustein</strong>e arbeiten mit einer Spannung von 3,3 V und<br />
bieten 600 bis 10.000 benutzbare Gatter sowie Counter-Geschwindigkeiten von<br />
bis zu 303,0 MHz, je nach <strong>Baustein</strong>.<br />
EPM7032AE Funktionen:<br />
32 Makrozellen<br />
2 dedizierte Global Clocks<br />
3,3V Spannung mit 2,5 bis 5V I/Os<br />
Support für 2 auswählbare I/O Standards<br />
Zusätzliche Funktionen der Aufsteckplatinen:<br />
Die Aufsteckplatine bietet eine 44 Pin und eine 84 Pin PLCC Buchse mit Support<br />
für die folgenden <strong>Baustein</strong>e: EPM3032A, EPM3064A, EPM7032S, EPM7064S,<br />
EPM7128S, EPM7160S, EPM7032AE, EPM7064AE, EPM7128AE, EPM7032B,<br />
EPM7064B, EPM7032S, EPM7064S, EPM7128S, EPM7160S.<br />
NanoBoard-NB1 2004: LiveDesign-fähiges, FPGA-basiertes Entwicklungsboard www.altium.com/nanoboard