Progetto di un capacimetro a microcontrollore per fotodiodi SPAD
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CAPITOLO 3. <strong>SPAD</strong>CAPMETER<br />
sono generati all’arrivo <strong>di</strong> nuovi pacchetti e/o a seguito <strong>di</strong> eventi speciali quali<br />
errori o con<strong>di</strong>zioni trappola. Essi vengono poi processati nel software in modo<br />
opport<strong>un</strong>o.<br />
Un’altra opzione fornita dal PIC18f4550 è lo Streaming Parallel Port (SPP),<br />
il quale consente <strong>di</strong> trasferire molti dati ad <strong>un</strong>a memoria esterna, in modalità<br />
parallela.<br />
Queste ed altre f<strong>un</strong>zionalità sono illustrate in Fig. 3.14.<br />
CPU e Memorie<br />
Il PIC18F4550 è <strong>un</strong> <strong>microcontrollore</strong> <strong>di</strong> tipo RISC 3 con architettura Harvard.<br />
L’architettura Harvard ha la memoria dei dati e del programma <strong>di</strong>stinte, accessibili<br />
me<strong>di</strong>ante due bus in<strong>di</strong>pendenti; questo <strong>per</strong>mette <strong>un</strong> notevole risparmio <strong>di</strong> tempo<br />
in fase <strong>di</strong> esecuzione delle o<strong>per</strong>azioni rispetto alla tra<strong>di</strong>zionale architettura von<br />
Neumann, la quale prevede <strong>un</strong>a sola memoria contenente dati e programma. Ciò<br />
<strong>un</strong>ito alla presenza <strong>di</strong> <strong>un</strong>’<strong>un</strong>ità <strong>di</strong> prefetch del co<strong>di</strong>ce e all’utilizzo <strong>di</strong> istruzioni<br />
RISC, consente <strong>di</strong> evitare <strong>di</strong> avere dei momenti nei quali la CPU è in stallo a causa<br />
della mancanza <strong>di</strong> istruzioni da eseguire o <strong>di</strong> dati su cui o<strong>per</strong>are. Le istruzioni<br />
RISC sono infatti <strong>un</strong> numero molto esiguo ma consentono <strong>di</strong> fare delle o<strong>per</strong>azioni<br />
base che, combinate opport<strong>un</strong>amente tra loro, riescono com<strong>un</strong>que a far fronte a<br />
tutte le istruzioni tipicamente presenti in <strong>un</strong> CISC 4 .<br />
Le istruzioni possono <strong>per</strong>ò anche essere long word, ovvero la CPU deve caricare<br />
più <strong>di</strong> <strong>un</strong> byte <strong>di</strong> istruzione prima <strong>di</strong> eseguirla; queste sono particolarmente utili nel<br />
caso <strong>di</strong> salti del programma in quanto viene memorizzato <strong>di</strong>rettamente l’in<strong>di</strong>rizzo<br />
<strong>di</strong> arrivo all’interno dell’istruzione stessa.<br />
Ogni istruzione dell’ALU è composto da 4 Q-Cycles:<br />
1. deco<strong>di</strong>fica dell’o<strong>per</strong>azione;<br />
2. lettura degli o<strong>per</strong>an<strong>di</strong>;<br />
3. esecuzione dell’istruzione;<br />
4. scrittura dei risultati.<br />
3 Reduced Instruction Set Computer<br />
4 Complex Instruction Set Computer<br />
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