第44 期: 面向未来十年的“All Programmable” - Xilinx
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金 融 领 域 的 出 色 表 现<br />
有现成的 C-to-HDL 编辑器工具<br />
可用,可将现有的 C 代码移植到硬件<br />
描述语言 (HDL),比用 HDL 从头开<br />
发代码速度快。但是,负责移植代码<br />
工作的人员必须熟悉硬件编程,或者<br />
必须遵循具体指南,才能生成可接受<br />
的代码。即便这样,生成的代码仍然<br />
可能会比用 HDL 直接开发的代码晦<br />
涩低效。<br />
为了降低在 FPGA 以太网卡上直<br />
接开发 HDL 代码所带来的风险,同<br />
时节省开发时间,AdvancedIO 公司<br />
率先尝试将 FPGA 框架用于 10G 以<br />
太 网 (10GE) 通 信。 我 们 的<br />
expressXG 开发框架工具套件为保证<br />
金融业务的快速部署提供了必要的基<br />
础 设 施, 可 无 缝 移 植 到 最 新 一 代<br />
FPGA 卡上。该工具套件可集成并优<br />
化应用开发所需的所有必要的核心功<br />
能,能够最大程度地降低第三方许可<br />
成本,让开发周<strong>期</strong>缩短数月。开发团<br />
队可随后将 C-to-HDL 编译器工具集<br />
<br />
<br />
(OMS)<br />
<br />
<br />
(ATS)<br />
<br />
成在框架中,从而为开发应用的不同<br />
部分提供多重选择。<br />
实际上两种方法都在项目中有一<br />
席之地。在优先考虑效率和代码紧凑<br />
度,或组件在多个项目中使用的情况<br />
下,最好使用 expressXG 框架直接开<br />
发 HDL 组件。如果着重考虑产品上市<br />
时间和定制化,或者要求以 C 语言编<br />
写代码的情况下,最好使用 C-to-HDL<br />
编译器。这种方法可以克服众多金融<br />
从业人员对 FPGA 的畏惧,同时不会<br />
影响性能。<br />
算法交易概览<br />
说到证券、衍生品、<strong>期</strong>货及其它金融<br />
工具的交易,总会让人联想起塞满几<br />
百人,叫嚷声此起彼伏的交易大厅。<br />
人们或漫无目的地转悠,或紧盯计算<br />
机屏幕。现实是,当今美国有 70% 以<br />
上的交易是由运行在计算机服务器上<br />
的算法完成的。在金融业,速度就是<br />
一切。哪家公司能够率先发现机遇并<br />
<br />
(EIS)<br />
把握机遇,就能够赢得丰厚的利润。<br />
对某些交易策略而言,率先进入队列<br />
就能赢得交易。这也就毫不奇怪众多<br />
公司竭尽所能地确保自身相对竞争对<br />
手的优势,哪怕是仅仅 1 微秒。<br />
在算法交易系统 (ATS) 中,由运<br />
行在高性能计算机上的算法处理交易,<br />
制定决策。这种系统运用多种技术来<br />
最大程度的降低时延,赢得竞争优势。<br />
具体包括与各个交易所共址、使用最<br />
短路径网络,以及使用 10G E 来降低<br />
时延这一日益风靡的做法。为在竞争<br />
中赢得优势,主要的交易公司同时采<br />
用上述所有技术。<br />
证券市场上的交易仅限于经纪人 -<br />
交易员和属于交易所成员的市场庄家<br />
机构之间。部分这类机构为其他交易<br />
公司提供服务,使他们能够通过他们<br />
的 帐 户 使 用“ 电 子 式 专 属 线 路 下 单<br />
(DMA)”给交易所下订单。提供“电子<br />
式专属线路下单”的机构必须建立交<br />
易前风险控制制度,以限制财务风险,<br />
<br />
<br />
(RMCS) <br />
<br />
图 1 - 交易系统的简图。<br />
蓝色框标出了 FPGA 将能够显著改善其性能的组件。<br />
(NYSE)<br />
(EREX)<br />
(CME)<br />
(CBOE)<br />
28 赛灵思中国通讯 44 <strong>期</strong> 2012 年第二季度