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TEI - Technische Grundlagen der Informatik 16.06.2003 Vorlesung 5 - Folie 12 5.11. Betriebsarten für DRAM Problem: - zeitliche Organisation von Refresh und Schreib/Lese-Zugriff Varianten: - Zeitmultiplex von Spalten- und Zeilenadresse Asynchrone DRAM („veraltet“) Prinzip: Prozessor und Speicher arbeiten unabhängig z.B.: Fast-Page-Mode (FPM-DRAM) Extended Data Out (EDO-DRAM) Synchrone DRAM (SDRAM) Prinzip: Prozessor gibt den Speichertakt vor z.B.: Direct Rambus (DRDRAM) Double Data Rate (DDR-SDRAM) © Prof. Dr.-Ing. M.Pollakowski
TEI - Technische Grundlagen der Informatik 16.06.2003 Vorlesung 5 - Folie 13 5.12. Geschwindigkeiten von RAM-Bausteinen Statische RAM: Zugriffszeiten: 1 - 20 ns (1 ns = 10 -9 s) Asynchrone DRAM: Zugriffszeiten: 50 - 100 ns Synchrone DRAM: nach Bustakt oder Übertragungsrate spezifiziert z.B.: PC100 für 100 MHz, d.h. Zugriffszeit 1/100MHz = 10 ns PC2100 für 2100MByte/s Übertragungsrate (2,1 GByte/s) Geschwindigkeitsklasse Beispiel PC200, PC266, DDR-SDRAM PC600, PC700, PC800 Rambus DRDRAM PC1600, PC2100 DDR-SDRAM Trends: - Trennung von Adress, Daten- und Steuerbus aufheben (Bus-Protokol) - Mischung von SRAM und DRAM (SRAM-Cache auf dem DRAM) Literatur hierzu: www.ct-online.de, www.tomshardware.de © Prof. Dr.-Ing. M.Pollakowski
Seite 1 und 2: TEI - Technische Grundlagen der Inf
Seite 11: TEI - Technische Grundlagen der Inf

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