Vorlesung Rechnerarchitektur - Fachbereich Informatik
Vorlesung Rechnerarchitektur - Fachbereich Informatik
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V erbes s erte A dres s berec hnung<br />
In unserem MU0 Modell verlieren wir jeweils einen Takt pro Befehl um im Fetch<br />
Zyklus die nächste Adresse für den Programmcounter zu berechnen.<br />
In dem verbesserten Ansatz kann die nächste Adresse direkt ohne über die ALU zu<br />
gehen in das Adressregister geladen werden<br />
Ein Addierer holt sich den Wert aus dem Adressregister, addiert einen Offset hinzu<br />
und schreibt bei Bedarf den Wert wieder in den Programmcounter zurück<br />
Jetzt kann der nächste Befehl, oder das nächste Datenwort geholt werden, ohne<br />
dass die ALU oder der C Bus belegt werden<br />
Begrenzt wird dieses Design durch den Umstand, dass der Wert im Instruction<br />
Register bis zum Ende des Befehls erhalten bleiben muss, weil darüber die<br />
Steuerung erfolgt<br />
<strong>Vorlesung</strong> <strong>Rechnerarchitektur</strong><br />
© Gerhard Raffius, WS 2009/10, h_da - <strong>Fachbereich</strong> <strong>Informatik</strong><br />
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