7. Speicher - Rechnersysteme
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<strong>7.</strong> <strong>Speicher</strong><br />
<strong>7.</strong>4 DRAM<br />
Takt<br />
Adressanschlüsse<br />
Datenbus<br />
� Zeitlicher Ablauf beim Lesevorgang (Burst mit<br />
Pipelining, wechseln der Zeile):<br />
Laden der<br />
Zeilenadresse<br />
r<br />
Laden der<br />
Spaltenadresse<br />
n<br />
CAS-<br />
Latenzzeit<br />
n n+1 n+2 n+3<br />
Burst<br />
Precharge-Zeit<br />
zum Rückschreiben<br />
des Zeileninhalts<br />
s<br />
Laden einer<br />
neuen<br />
Zeilenadresse<br />
92
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