Teoria - LSI - USP
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Projeto<br />
Lógico<br />
Semi Personalizados<br />
Ferramentas de C.A.D<br />
Biblioteca de<br />
Células<br />
Lay-out<br />
Metodologia de Projeto com Arranjo de Portas (Gate Array)<br />
CHIP<br />
C. I. já difundido, só falta a camada de interconexão<br />
Pode ter uma ou duas camadas de interconexão<br />
Cada célula contém transistores isolados (CMOS)<br />
Vantagens: Menor número de máscaras<br />
Baixo custo<br />
Realização rápida<br />
Desvantagens:<br />
Muitas interconexões<br />
Baixa utilização da superfície<br />
Otimização impossível