Please purchase PDF Split-Merge on www.verypdf.com to ... - Patrz
Please purchase PDF Split-Merge on www.verypdf.com to ... - Patrz
Please purchase PDF Split-Merge on www.verypdf.com to ... - Patrz
- TAGS
- purchase
- patrz
- www30.patrz.pl
Create successful ePaper yourself
Turn your PDF publications into a flip-book with our unique Google optimized e-Paper software.
Dyski twarde i elastyczne<br />
gdzie:<br />
neyl- numer cylindra (numeracja od O)<br />
lhead- liczba glowic<br />
nhead- numer glowicy<br />
l sec/tr -liczba sek<strong>to</strong>rów na sciezke<br />
nsee- numer sek<strong>to</strong>ra na sciezce (od war<strong>to</strong>sci 1).<br />
W przypadku rozszerz<strong>on</strong>ego adresu CHS (czyli XCHS) omija sie ograniczenia<br />
BIOS-u podajac fikcyjna liczbe cylindrów i glowic. Jezeli liczba glowic podawana<br />
przez IDE przekracza war<strong>to</strong>sc 16, jest OM zmniejszana do 16, a w zamian zwiekszana<br />
jest podawana liczba cylindrów tak, aby osiagnac zadana pojemnosc.<br />
3.4.1.3. Tryby transmisji<br />
Przesylanie informacji pomiedzy pamiecia operacyjna a napedem dyskowym<br />
moze sie odbywac w jednym z dwóch podstawowych trybów: PlO - programowanego<br />
wejscia/wyjscia (ang. Programmable Input Output) lub DMA - bezposredniego dostepu<br />
do pamieci (ang. Direet Memmy Aeeess). Podstawowa róznica pomiedzy tymi<br />
trybami zostala opisana w czesci I podrecznika, gdzie opisano takze w sposób bardziej<br />
szczególowy realizacje operacji DMA. Tu przypomnimy zasadnicza róznice pomiedzy<br />
tymi trybami. W trybie PlO informacja pomiedzy dyskiem a pamiecia przesylana jest<br />
za posrednictwem rejestrów procesora. Stad przykladowo przeslanie jednego bajtu<br />
wymaga wyk<strong>on</strong>ania dwóch rozkazów procesora: przykladowo rozkaz IN - wczytanie<br />
war<strong>to</strong>sci z rejestru k<strong>on</strong>trolera dysku do rejestru procesora i rozkaz MOV - przeslanie<br />
zawar<strong>to</strong>sci rejestru procesora do pamieci. Stad operacja ta angazuje czas procesora,<br />
ale tez (co w pewnych przypadkach ma is<strong>to</strong>tne znaczenie) jest Wyk<strong>on</strong>ywana z szybkoscia,<br />
która zalezy od czes<strong>to</strong>tliwosci taktujacej zegara procesora. Dla DMA, po zapoczatkowaniu<br />
operacji przez procesor, przebiega <strong>on</strong>a dalej pod nadzorem ukladu zwanego<br />
k<strong>on</strong>trolerem DMA. K<strong>on</strong>troler ten ma wlasny zegar, od którego zalezy szybkosc<br />
transmisji. ~peracja odczytu i zapisu danych ma miejsce w tym samym cyklu DMA <br />
inaczej mówiac, operacja ta nie jest buforowana, przesylana war<strong>to</strong>sc nie jest wpisywana<br />
do zadnego rejestru posredniego, lecz jest przesylana bezposrednio pomiedzy<br />
pamiecia a ukladem wejscia wyjscia. Odciazenie procesora wystepujace dzieki DMA<br />
ma szczególnie duze znaczenie przy wielozadaniowych systemach operacyjnych<br />
i pozwala efektywniej wykorzystac czas procesora.<br />
Rysunki 3.29 a, b i c pokazuja realizacje transmisji odpowiednio: w trybie PlO,<br />
Single-word DMA (transmisja DMA pojedynczymi slowami), i Multi-word DMA<br />
(transmisja blokowa DMA).<br />
<str<strong>on</strong>g>Please</str<strong>on</strong>g> <str<strong>on</strong>g>purchase</str<strong>on</strong>g> <str<strong>on</strong>g>PDF</str<strong>on</strong>g> <str<strong>on</strong>g>Split</str<strong>on</strong>g>-<str<strong>on</strong>g>Merge</str<strong>on</strong>g> <strong>on</strong> <strong>www</strong>.<strong>verypdf</strong>.<strong>com</strong> <strong>to</strong> remove this watermark.<br />
8:)