10. Programmierbare Logikbausteine - Fachgebiet Rechnersysteme ...
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<strong>Fachgebiet</strong> <strong>Rechnersysteme</strong><br />
Vorlesung Logischer Entwurf<br />
Technische Universität<br />
Darmstadt<br />
<strong>10.</strong> <strong>Programmierbare</strong> <strong>Logikbausteine</strong><br />
6.2 PLA's, PAL's, PROM's<br />
26<br />
<strong>10.</strong> <strong>Programmierbare</strong> <strong>Logikbausteine</strong><br />
<strong>10.</strong>2 PLA's, PAL's, PROM's<br />
28<br />
Personalisierungsdaten adressieren die zu zerstörenden<br />
Verbindungen<br />
Adresse besteht aus<br />
Zeilen- und Spaltenadresse<br />
x 1<br />
x 2 ... x 10<br />
Anlegen der Adresse<br />
&<br />
&<br />
über Pins des Bausteins<br />
...<br />
...<br />
...<br />
• GAL‘s (Generic Array Logic)<br />
Handelsmarke von Lattice<br />
~ PAL‘s, aber die OLMC‘s<br />
(Output Logic Macro<br />
Cells) sind konfigurierbar:<br />
&<br />
Zeilenadresse<br />
&<br />
...<br />
≥ 1 ≥ 1<br />
Spaltenadresse<br />
o 1 o 8<br />
10-7<br />
<strong>10.</strong> <strong>Programmierbare</strong> <strong>Logikbausteine</strong><br />
<strong>10.</strong>2 PLA's, PAL's, PROM's<br />
27<br />
<strong>10.</strong> <strong>Programmierbare</strong> <strong>Logikbausteine</strong><br />
<strong>10.</strong>2 PLA's, PAL's, PROM's<br />
29<br />
Anlegen von kurzfristig (z.B. 10µs) erhöhten<br />
Spannungsimpulsen (z.B. 10,75V statt 5V)<br />
Modi<br />
— Registered<br />
10µs<br />
10V<br />
5V<br />
0<br />
Vielfalt an Varianten, z.B. Programmieren des bereits<br />
plazierten Bausteins über Anschlüsse, die für das<br />
Testen benutzt werden
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