UN NUOVO MODELLO ELETTROTERMICO DI FET IN GaAs PER IL ...
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<strong>UN</strong> <strong>NUOVO</strong> <strong>MODELLO</strong> <strong>ELETTROTERMICO</strong> <strong>DI</strong> <strong>FET</strong> <strong>IN</strong> <strong>GaAs</strong> <strong>PER</strong> <strong>IL</strong> PROGETTO TERMICAMENTE OTTIMIZZATO<br />
DEI PARAMETRI DEL LAYOUT<br />
(A NEW ELECTROTHERMAL MODEL OF GAAS <strong>FET</strong>S FOR THE THERMALLY OPTIMIZED LAYOUT DESIGN)<br />
Fig. 7. Resistenza termica R TH<br />
del <strong>FET</strong> al variare della lunghezza di gate L e della spaziatura tra i gate S per n = 14 e P = 1 W.<br />
R TH<br />
R TH<br />
NOTE<br />
Fig. 8. Resistenza termica del <strong>FET</strong> R TH<br />
al variare del numero delle dita di gate n e della spaziatura tra i gate S<br />
per L = 1 mm e P = 1 W.<br />
La Comunicazione - numero unico 2000<br />
99