ARM PrimeCell - ARM Information Center
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プログラマモデル<br />
3.2 レジスタの 説 明<br />
このセクションでは、 以 下 のレジスタについて 説 明 します。<br />
• LCDTiming0 [32] (+ 0x00):P. 3-4<br />
• LCDTiming1 [32] (+ 0x04):P. 3-6<br />
• LCDTiming2 [27] (+ 0x08):P. 3-8<br />
• LCDTiming3 [17] (+ 0x0C):P. 3-10<br />
• LCDUPBASE [32] (+ 0x10) および LCDLPBASE [32] (+ 0x14):P. 3-10<br />
• LCDINTRENABLE [5] (+ 0x18):P. 3-11<br />
• LCDControl [16] (+ 0x1C):P. 3-12<br />
• LCDStatus [5] (+ 0x20):P. 3-14<br />
• LCDInterrupt [5] (+ 0x24):P. 3-14<br />
• LCDUPCURR [32] (+ 0x28) および LCDLPCURR [32] (+ 0x2C):P. 3-15<br />
• LCDPalette [32] (+ 0x0200 - 0x3FC):P. 3-15<br />
• 割 り 込 み:P. 3-17<br />
各 レジスタの 説 明 において、その 表 題 を 以 下 の 形 式 で 記 載 しています。<br />
レジスタ 名 [ ビット 幅 ](ベースからのオフセット)<br />
3.2.1 LCDTiming0 [32] (+ 0x00)<br />
LCDTiming0 は、 以 下 を 制 御 する 読 み 出 し / 書 き 込 みレジスタです。<br />
• 水 平 同 期 パルス 幅 (HSW)<br />
• 水 平 フロントポーチ(HFP) 周 期<br />
• 水 平 バックポーチ(HBP) 周 期<br />
• 行 当 たりピクセル 数 (PPL)<br />
3-4 Copyright © <strong>ARM</strong> Limited 1999, 2000. All rights reserved. <strong>ARM</strong> DDI0161DJ-00
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