Tesis previa a la obtención del -titulo de Ingeniero Electrónico en la ...
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Cuando no se produce ninguna l<strong>la</strong>mada <strong>la</strong> señal SLLC que provie<br />
ne <strong><strong>de</strong>l</strong> selector <strong>de</strong> l<strong>la</strong>madas que se verá más a<strong>de</strong><strong>la</strong>nte, está normalm<strong>en</strong>-<br />
te <strong>en</strong> UNO, por lo que a <strong>la</strong> salida <strong>de</strong> <strong>la</strong> compuerta 7416 se ti<strong>en</strong>e un CE<br />
RO. Este nivel lógico po<strong>la</strong>riza a los diodos DI y D2 directam<strong>en</strong>te im-<br />
pidi<strong>en</strong>do que los' capacitores Cu y Q 2 puedan cargarse y los aesta-<br />
bles permanecerán bloqueados. La salida <strong>de</strong> los g<strong>en</strong>eradores se quedan<br />
<strong>en</strong> alto <strong>de</strong>bido .a <strong>la</strong> realim<strong>en</strong>tación positiva, pero <strong>la</strong> configuración in<br />
versora <strong><strong>de</strong>l</strong> comparador manti<strong>en</strong>e <strong>en</strong> el bajo su salida y el transistor<br />
Darlington estará cortado.<br />
Al producirse una l<strong>la</strong>mada <strong>la</strong> señal S cambia a CERO, a <strong>la</strong> sali,<br />
da <strong>de</strong> <strong>la</strong> compuerta inversora se ti<strong>en</strong>e un UNO que po<strong>la</strong>riza a los dio-<br />
•dos inversam<strong>en</strong>te permiti<strong>en</strong>do que los aestables puedan funcionar.<br />
La resist<strong>en</strong>cia Rñf; se calcu<strong>la</strong> consi<strong>de</strong>rando <strong>la</strong> salida <strong>en</strong> CERO.<br />
Para un 7416<br />
VQL=0.4V '<br />
I = 10 irA (limitación)<br />
kíí Se eSCOge ?V86 = 1'2 k<br />
Se escoge una resist<strong>en</strong>cia <strong>de</strong> 1.2 Kfi para limitar <strong>la</strong> corri<strong>en</strong>-