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广州周立功单片机发展有限公司 Tel (020)38730976 38730916 Fax 38730925 http //www.zlgmcu.com<br />
注<br />
图 8-1 包含了数据读和写访问的时序 WRITE 信号用来指示是否使用 RDATA 或 WDATA 端口<br />
当读或写处理不能在一个周期内完成时 CLKEN 为低使数据访问延长 当处理信号 TRANS[1:0]指示<br />
一个有效的存储器周期或一个协处理器寄存器传送周期时 数据总线只用于传送<br />
8.1.2 协处理器时序<br />
协处理器时序<br />
协处理器时序如图 8-2 所示<br />
CL K<br />
CP A<br />
CP B<br />
CP nI<br />
CP nMRE Q<br />
CPSEQ<br />
CP nOPC<br />
CP nTRA NS<br />
CP TBIT<br />
t ovcpni<br />
t ovcpctl<br />
t ovcpctl<br />
8.1.3 异常和配置输入时序<br />
异常和配置输入时序<br />
异常和配置输入时序参数如图 8-3 所示<br />
8.1.4 调试时序<br />
调试时序<br />
调试时序参数如图 8-4 所示<br />
CL K<br />
nFIQ<br />
nIRQ<br />
nRESET<br />
CF GB IGEND<br />
- 81 -<br />
t iscpstat<br />
图 8-2 协处理器时序<br />
t isexc<br />
t isexc<br />
t iscfg<br />
t ihcpstat<br />
t ohcpni<br />
t ohcpctl<br />
t ohcpctl<br />
t ihexc<br />
t ihexc<br />
t ihcfg<br />
图 8-3 异常和配置输入时序
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