PDF version - ARM Information Center
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프로세서 예외 처리예제 6-20에서는 6-38페이지의 예제 6-19에 나와 있는 SCS 구조체에 대해 IRQ를활성화하는 일반적인 함수를 보여 줍니다.예제 6-20 IRQ 활성화 함수void NVIC_enableISR (unsigned isr){/* The isr argument is the number of the interrupt to enable. */SCS.NVIC.Enable[ (isr/32) ] = 1