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PDF version - ARM Information Center

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<strong>ARM</strong> 프로세서용 소프트웨어 개발표 2-1 주요 기능 (계속)프로세서아키텍처강하게 결합된 메모리 (TightlyCoupledMemory)메모리 관리Thumb-2Cortex -M1 <strong>ARM</strong>v6-M 예 - -Cortex-A8 <strong>ARM</strong>v7-A - MMU 예Cortex-A9 <strong>ARM</strong>v7-A - MMU 예Cortex-R4 및 Cortex-R4F <strong>ARM</strong>v7-R 변수 MPU 예Cortex-M3 <strong>ARM</strong>v7-M - MMU (옵션) Thumb-2만 해당2.1.1 다중 처리 시스템<strong>ARM</strong> 아키텍처 v6K에는 최대 4개의 CPU 및 관련 하드웨어를 지원하는 최초의MPCore 프로세서가 도입되었습니다. 성능을 최적화하려면 응용 프로그램을 다중 처리 시스템에서 실행하도록 특수하게 설계해야 합니다. 예를 들어 특정 CPU를 단일 스레드 응용 프로그램에서 특정 작업만 수행하도록 지정하거나 다중 스레드 환경에서 병렬 처리되도록 사용할 수 있습니다. 효율성이 높은 다중 처리 시스템의 경우 전력 소비량과 발열 정도가 낮으며, CPU 가 하나뿐인 시스템에 비해반응성은 높은 반면, 복잡하므로 디버깅 작업은 더 어렵습니다.다중 처리 시스템을 설계할 때는 다음과 같은 몇 가지 항목을 고려해야 합니다.• LDREX/STREX를 통해 동기화를 수행함으로써 뮤텍스 또는 세마포를 만들어 중요 섹션 및 공유할 수 없는 리소스를 보호합니다.• 대칭 다중 처리를 위해 캐시 결합성을 적용합니다.• 별도의 스레드에서 반복 작업을 실행합니다.• 큰 작업을 여러 스레드로 분할하여 병렬로 실행합니다.• 초기 작업에 CP15 CPU ID 레지스터를 사용하여 기본 CPU를 설정합니다.• 인터럽트 우선순위를 지정합니다.• 인터럽트 발생 순서에 비트 마스킹을 사용합니다.• 타이머 또는 watchdog을 트리거하는 사이클 수를 구성합니다.<strong>ARM</strong> DUI 0203IK Copyright © 2002-2008 <strong>ARM</strong> Limited. All rights reserved. 2-3Unrestricted AccessNon-Confidential

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