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{V}erifikation der diskreten - Embedded Systems Group

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eellen Zahlen beruht während Schaltungsrealisierungen Zahldarstellung begrenzterGenauigkeit verwenden. Durch verschiedene Berechnungen können sich somitRechenungenauigkeiten ergeben. Sollten die Ergebnisse an einigen <strong>der</strong> Ausgänge voneinan<strong>der</strong>abweichen, so soll herausgefunden werden, ob man mittels Modellprüfung zeigen kann, daßdiese Differenz immer kleiner als eine zu ermittelnde obere Schranke ist.Zur Durchführung <strong>der</strong> Modellprüfungsexperimente wurde auf den Modellprüfer SMV <strong>der</strong>Carnegie Mellon Universität (Pittsburg, USA) zurückgegriffen.1.4 Glie<strong>der</strong>ung <strong>der</strong> ArbeitIm folgenden Abschnitt wird die Notwendigkeit <strong>der</strong> Hardware-V<strong>erifikation</strong> erläutert. Danachwird die temporale Logik CTL vorgestellt, die zur Spezifikation von Systemen dient. Systemewerden hierbei durch endliche Transitionssysteme (Kripke Strukturen) modelliert. CTL erlaubtnun eine effiziente Modellprüfung [8], welche auf <strong>der</strong> effizienten Speicherung vonZustandsmengen durch binäre Entscheidungsdiagramme [2] beruht. Daher befaßt sichAbschnitt 4 mit binären Entscheidungsdiagrammen. Der Abschnitt nach den binärenEntscheidungsdiagrammen erläutert die mathematische Definition <strong>der</strong> <strong>diskreten</strong>Cosinus-Transformation sowie einige Optimierungen. Der letzte Abschnitt befaßt sich dannmit <strong>der</strong> praktischen Durchführung <strong>der</strong> V<strong>erifikation</strong> <strong>der</strong> beiden gewählten <strong>diskreten</strong>Cosinus-Transformationen sowie mit den experimentell ermittelten Ergebnissen.6

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