轻松实现高速串行I/O
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SERDES 示例资料—RocketIO X 收发器概述<br />
表1-4 设计原型端口(续)<br />
端口<br />
输入/输出<br />
(I/O)<br />
端口大小 定义<br />
TXUSRCLK I 1 从DCM输出的时钟,时钟和<br />
REFCLK(或其他参考时钟)同<br />
步。此时钟是写TX缓冲器的时钟<br />
信号,它相对REFCLK是频率锁<br />
定的。TXUSRCLK和<br />
TXUSRCLK2必须保持180度的<br />
相位差。<br />
TXUSRCLK2 I 1 从DCM输出的时钟信号,为发送<br />
器的数据提供时钟,同时也是收<br />
发器和FPGA结构之间状态和重<br />
配置数据的时钟。TXUSRCLK和<br />
TXUSRCLK2之间的比例取决于<br />
TXDATA的宽度。TXUSRCLK和<br />
TXUSRCLK2必须保持180度的<br />
相位差。<br />
注:<br />
1 端口大小取决于所使用的设计原型(1,2,4,8字节)。<br />
2 端口大小取决于所使用的设计原型(8,16,32,64字节)。<br />
设计原型属性<br />
设计原型中还包括一些其他的属性,其值被缺省设置,以控制具体设计原型的相关协议参数。<br />
这些属性包括:通道绑定设置(对于支持通道绑定的设计原型而言),和时钟修正序列。表<br />
1-5 给出了每个属性的大体描述。<br />
表1-5 RocketIO X 收发器属性<br />
属性 类型 描述<br />
ALIGN_COMMA_WORD Integer 整数(1, 2, 4) 控制在收发器的4字节<br />
(整型)<br />
宽数据通道中检测到的comma字符<br />
的对齐。<br />
CHAN_BOND_64B66B_SV Boolean TRUE/FALSE(真/假)。此信号保<br />
(布尔)<br />
留为将来使用,其值必须保持为<br />
FALSE。<br />
CHAN_BOND_LIMIT Integer 整数1-63定义了从接收器在跟随通<br />
(整型)<br />
道绑定序列并保持成功对齐的情况<br />
下所能读取的最大字节数。此属性必<br />
须设置为16。<br />
120·Xilinx
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