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VLSI Design 03/04 - <strong>Logikfamilien</strong> Tri-State Ausgang � Die zwei in Serie geschalteten MOS des Gated Inverters kann man verhindern (Ausgangsstrom!), indem man Logik vorschaltet. � Nicht-Invertierender Tri-State Buffer: en in en ⋅in en ⋅in out � Sehr wichtiger Ausgangs-Typ in Bus-Systemen! en=0 out out in en=1 P. Fischer, TI, Uni Mannheim, Seite 74
VLSI Design 03/04 - <strong>Logikfamilien</strong> Einschub: Widerstand eines MOS � Vom Widerstand kann man nur im linearen Bereich sprechen, d.h. wenn � In diesem Bereich gilt: 0 < V DS « V GS – V T I D = K W/L [ (V GS – V T ) V DS – ½ V DS 2 ] = K W/L [ VGS – V T – ½ V DS ] V DS � In der [] - Klammer kann man ½ V DS gegenüber V GS -V T vernachlässigen, also gilt näherungsweise � Also ist der Leitwert des Kanals I D ~ K W/L (V GS – V T ) V DS g DS = I D / V DS ~ K W/L (V GS – V T ), der Kehrwert ist der Widerstand � Einsetzen von Werten einer 0.35 µm Technologie ergibt (für einen minimalen NMOS bei 3.3V) g DS ~ 175 µA/V 2 x 0.8µm/0.35µm x (3.3V – 0.5V) ~ 1mA/V, d.h. 1kW P. Fischer, TI, Uni Mannheim, Seite 75
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� Schaltbild zur Simulation der n
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� Für den NMOS ist V GS = V in ,
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� Hiermit ist meist Durchlaufzeit
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