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52 PCB giugno 2011
Tuttavia, l’impatto della modifica
non ricade solo intorno all’FPGA; il
nuovo pin-out produce un effetto anche
sulle vie di accesso ai singoli piedini del
componente stesso. Per riuscire a ridisporre
il ventaglio di tracce complanari
che fanno confluire i segnali verso il bus,
è stato necessario spostare anche l’estremità
del percorso topologico; diversamente,
si sarebbe reso indispensabile
un accavallamento di alcune tracce, con
uno spreco di prezioso spazio su un pcb
piuttosto denso. L’inversione dei bit
avrebbe richiesto dello spazio addizionale
per delle tracce ed alcune via, una
esigenza complicata da soddisfare nelle
fasi finali del progetto. Se i tempi stringono,
il lavoro necessario per apportare
le dovute correzioni a tutte le tracce
coinvolte potrebbe essere inaccettabile.
In sostanza: lavorando ad un livello
di astrazione superiore, come permesso
dalla pianificazione topologica, è molto
più semplice gestire e soddisfare gli
onnipresenti ECO. Un algoritmo di
sbroglio automatico pensato per seguire
l’intento del progettista sa inoltre privilegiare
la qualità del risultato rispetto
alla quantità. Se viene identificato un
problema qualitativo, piuttosto che creare
uno sbroglio di qualità scadente, è
meglio fallire una delle connessioni.
Questo per due motivi. Anzitutto,
perché è più semplice trovare una soluzione
manuale per riallacciare una sin-
Fig. 13a - Esempio di un piano topologico completo
per un pcb
gola connessione fallita piuttosto che
ripulire numerosi percorsi di bassa
qualità di tracce generate dallo sbroglio
automatico. In secondo luogo,
perché così viene comunque rispettato
l’intento del progettista, rappresentato
soprattutto dalla qualità della
connessione da esso stabilita. Non va
comunque negato che queste considerazioni
sono valide fintantoché la
ricongiunzione delle tracce fallite è
ragionevolmente semplice e localizzata.
Un buon esempio è rappresentato da
uno sbroglio che non riesce a raggiungere
il 100% di connessione del piano.
Piuttosto che forzare il risultato, sacrificandone
la qualità, è meglio lasciare
parzialmente insoddisfatto il piano, tollerando
una traccia non connessa. In tal
modo, tutte le tracce saranno instradate
nel rispetto del piano, anche se non tutte
in modo completo fino al piedino del
componente. Ciò però garantirà la presenza
di sufficiente spazio residuo per
aggiustare la connessione fallita e per
farlo in modo ragionevolmente semplice.
L’intelligenza del progettista
e la velocità del routing
automatico
La progettazione dei bus di un
pcb “alla vecchia maniera”, vale a dire
mediante un piano di sintesi disegnato
su un pezzo di carta, seguito da
un minuzioso tracciamento manuale
delle singole interconnessioni, è un processo
spesso lungo e tedioso. Mentor
Graphics offre ora una nuova tecnologia
in grado di combinare l’intelligenza
di un progettista esperto con la velocità
di un sistema automatico di sbroglio,
migliorando così significativamente
sia la produttività del progettista che i
tempi del ciclo di sviluppo.
Lo strumento Topology Planner
consente al progettista di acquisire le
strutture e le topologie dei bus, assicurando
nel contempo che il piano generato
sarà sbrogliabile e che soddisferà,
nelle lunghezze e nei ritardi, i vincoli
di qualità dei segnali. Il piano entra a
far parte del database di progetto sotto
forma di PI, per poter essere corretto ed
utilizzato nelle fasi successive. Lo strumento
Topology Router implementa
le direttive contenute nel piano con la
velocità tipica di un router automatico,
producendo risultati di elevata qualità e
sollevando il progettista da un compito
lungo e tedioso. Alla fine, ne risultano sia
un processo molto più efficiente che una
significativa quantità di tempo risparmiato
per i progettisti, i quali potranno
dedicarlo alla soluzione di altre sfide più
impegnative, che richiedono tutta la loro
sofisticata esperienza.
Mentor Graphics
www.mentor.com
Fig. 13b - In tempi dell’ordine dei minuti, il Topology Router
può sbrogliare automaticamente le relative strutture di bus,
nel rispetto del piano topologico