Logikfamilien (4.2 MB)
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Bereiche in der Transferkennlinie<br />
NMOS off<br />
PMOS lin<br />
V IL<br />
� Die Schwellen sind etwa da, wo Steigungen = -1 sind.<br />
NMOS sat<br />
PMOS lin<br />
NMOS sat<br />
PMOS sat<br />
NMOS lin<br />
PMOS sat<br />
NMOS lin<br />
PMOS off<br />
� Beachte: Dies gilt für einen 'statischen' DC-Sweep. Beim dynamischen Schalten sind die Transistoren<br />
schneller im linearen Bereich, weil die Gatespannung dann VDD bzw. 0 ist.<br />
VLSI Design: <strong>Logikfamilien</strong><br />
V T<br />
V IH<br />
P. Fischer, ZITI, Uni Heidelberg, Seite 12
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