Logikfamilien (4.2 MB)
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out<br />
A B A ⊕ B<br />
0 0 0<br />
0 1 1<br />
1 0 1<br />
1 1 0<br />
B B out<br />
A = 1 A = 0<br />
XOR mit Pass Gate Logik<br />
B<br />
A<br />
A<br />
A⊕B<br />
!A<br />
!B<br />
Möglichkeit 1:<br />
MUX<br />
4 MOS + 2 Inverter<br />
Vorsicht: Bei der Abschätzung der Geschwindigkeit muss man die MOS in den Schaltungen berücksichtigen,<br />
die die Signale A und B erzeugen!<br />
VLSI Design: <strong>Logikfamilien</strong><br />
B<br />
B<br />
!A<br />
A⊕B<br />
B<br />
Möglichkeit 2:<br />
Raffiniert!<br />
4 MOS + 1 Inverter<br />
P. Fischer, ZITI, Uni Heidelberg, Seite 75
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