Logikfamilien (4.2 MB)
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Noch mehr TSPC<br />
� D-Flipflop, auf positive Flanke getriggert, 'split-output-latch'<br />
D<br />
φ<br />
V DD<br />
φ<br />
φ<br />
X<br />
V DD<br />
Y<br />
φ<br />
V DD<br />
D<br />
D<br />
φ<br />
V DD<br />
φ<br />
φ<br />
V DD<br />
φ<br />
V DD<br />
(a) Positive edge-triggered D flip-flop (b) Negative edge-triggered D flip-flop<br />
D<br />
VLSI Design: <strong>Logikfamilien</strong><br />
φ<br />
V DD<br />
φ<br />
V DD<br />
V DD<br />
(c) Positive edge-triggered D flip-flop<br />
using split-output latches<br />
D<br />
D<br />
P. Fischer, ZITI, Uni Heidelberg, Seite 129
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