Logikfamilien (4.2 MB)
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RC Verzögerung in Transmission Gates (wie vorher)<br />
1 2 N<br />
R eff<br />
N x R eff<br />
VLSI Design: <strong>Logikfamilien</strong><br />
N x C eff<br />
RC ~ R effC eff x N 2<br />
Grobe Näherung !<br />
C eff<br />
P. Fischer, ZITI, Uni Heidelberg, Seite 78