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Neue Produkte<br />

PC1-Groove<br />

CPU Karte mit Core i7 Processor<br />

Die CPU-Karte PC1-Groove von EKF ist geeignet<br />

für CompactPCI Classic und PICMG 2.30 CompactPCI<br />

PlusIO Systeme. Es ist eine leistungsstarke<br />

4TE/3HE CompactPCI Zentraleinheit bestückt<br />

mit einem Intel Core i7 Prozessor, skalierbar<br />

von 1,06GHz bis zu 2,66GHz Takt (Turbo<br />

Boost bis 3,2GHz). Die Frontplatte enthält 2 Gi-<br />

Bild: EKF<br />

gabit Ethernet Buchsen, zwei USB und wahlweise<br />

entweder den Vesa DisplayPort für hochauflösende<br />

Displays (DVI per Adapter) oder alternativ<br />

den klassischen VGA Connector. In Übereinstimmung<br />

mit der PICMG 2.30 CompactPCI<br />

PlusIO ermöglicht die PC1-Groove die rückwärtige<br />

Erweiterung über den Backplane Steckverbinder<br />

J2 mit schnellen I/O Kanälen wie PCI<br />

Express, SATA und Gigabit Ethernet. Dadurch<br />

kann die PC1-Groove in einem hybriden System<br />

als Brücke zu PICMG CompactPCI Serial Karten<br />

dienen. In einem klassischen CompactPCI System<br />

kann optional ein 2.30 kompatibles Rear<br />

I/O Modul wie z.B. PR1-RIO verwendet werden.<br />

infoDIREKT <br />

473ei0411<br />

Kundenspezifische IC-Designs<br />

Sofortigen Signoff-Verifikation<br />

Mit Calibre-RealTime von Mentor Graphics ist<br />

jetzt bereits während der Layouterstellung die<br />

physikalische Verifikation in Signoff-Qualität<br />

möglich. Die erste Version gestattet die sofortige<br />

Prüfung der Entwurfsregeln (Design Rule<br />

Checking) in SpringSofts Laker Custom IC-<br />

Bild: Mentor Graphics<br />

Design und Layout-Lösungen. Dies geschieht<br />

mit den gleichen Calibre-Regeldateien wie im<br />

Signoff-Flow. Die neue Lösung beschleunigt<br />

den Schaltungsentwurf und verbessert die<br />

Qualität der Ergebnisse, da hier den Designern<br />

erstmals während der Designphase die volle<br />

Leistungsfähigkeit der Calibre-Signoff-Engines<br />

in Verbindung mit qualifizierten Regeldateien<br />

zur Verfügung steht. Dadurch können sie ihre<br />

Layouts hinsichtlich Performance optimieren,<br />

ohne Abstriche an der Fertigungsausbeute<br />

machen zu müssen. Eine Version für die Mentor<br />

Custom IC Designumgebung IC Station wird<br />

ab Juni erhältlich sein.<br />

infoDIREKT <br />

541ei0411<br />

Analog- und Mixed-Signal-Designs<br />

20 nm Prozesstechniken mit DFM- und Power-Analysen<br />

Virtuoso<br />

QRC Extraction<br />

Virtuoso Power System<br />

Spectre/APS/UltraSim Simulation<br />

Power Rail & Signal EM Analysis<br />

Cadence hat den Virtuoso-basierten Custom/<br />

Analog-Flow deutlich erweitert. Er stellt nun<br />

DFM-Funktionen während der Design-Phase<br />

zur Verfügung. Bereits während des Entwurfsprozesses<br />

werden so automatisch potenzielle<br />

DFM-Verstöße eingegrenzt und behoben.<br />

Das Virtuoso Power System bietet eine<br />

Bild: Cadence<br />

integrierte, umfassende und genaue Signoff-<br />

Möglichkeit zur Lösung von Problemen der<br />

Leistungs- und Signalintegrität im Design,<br />

beispielsweise Auswirkungen von IR-Drop<br />

und Elektromigration, wie Kurzschlüsse und<br />

Hotspots. Eine Funktion zur parasitären Abschätzung<br />

ermöglicht eine frühzeitige Untersuchung<br />

der parasitären Effekte bei der Layout-Implementierung.<br />

Adressiert werden Leitungs-<br />

und Bauelementeparasiten, Well Proximity<br />

Effekte und lithographiebedingte<br />

Schwankungen, um zeitaufwändige Iterationen<br />

am Ende des Entwicklungsprozesses zu<br />

verhindern.<br />

infoDIREKT <br />

540ei0411<br />

www.<strong>elektronik</strong>-<strong>industrie</strong>.de <strong>elektronik</strong> <strong>industrie</strong> 04/2011 77<br />

77_PB.indd 77 01.04.2011 13:41:45

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