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Digitaltechnik (#2031) Wintersemester 2007/2008 Kapitel 0 ...

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FPGA-Entwurfsprozess (1)<br />

Der Entwurfsprozess umfaßt 2 prinzipielle Stufen:<br />

1. Entwurfseingabe<br />

(Frontend)<br />

Netzliste: Namen und<br />

Verbindungen aller Pins<br />

VHDL = VHSIC HDL<br />

VHSIC = Very High Speed IC<br />

2. Implementierung<br />

(Backend)<br />

Technologieabhängig,<br />

Tools vom Hersteller<br />

Bitstream beschreibt die<br />

Konfiguration des FPGAs<br />

Graphische<br />

Schaltplaneingabe<br />

Netzliste<br />

Technologieabbildung<br />

(Mapping)<br />

Bitstream<br />

© G. Fries<br />

Graphische VHDL<br />

Generierung<br />

VHDL Modell<br />

Simulation<br />

und<br />

Verifikation<br />

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