Abschlussbericht_PowerTower - Projektlabor - TU Berlin

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Nun konnte es zur “Hochzeit“ mit der WoM-Erkennung kommen: Abbildung 9.29: “Hochzeit“ der WoM-Erkennung mit der WoM-Logik (Testaufbau) Schaltpläne Es folgen nun einige Schaltpläne: Um ein Dauerhaftes Signal in einen Impuls zu Wandeln haben wir die folgende Teilschaltung verwendet: Abbildung 9.30: Signal in Impuls-Wandler Ihre Funktionsweise beruht darauf, dass solange sich der Kondensator 82
auflädt, eine Spannung über diesem Abfällt, und das AND-Gatter somit für diese Dauer an einem der Eingänge ein “High“-Signal bekommt. Gekoppelt mit dem anderen länger andauernden “High“-Signal ergibt das unseren benötigten Impuls. Und so sieht die Vollständige WoM-Logik-Schaltung aus: Abbildung 9.31: Vollständige WoM-Logik Dabei wurde die Timer-Schaltung, die aus dem 555-Timer Baustein und den dahinter liegenden Flip-Flops als Frequenzteiler besteht (siehe Konzept), mit den Signal-Impuls-Wandlern an beiden Ausgängen des letzten Flip-Flops realisiert. Simulationsergebnisse Der noch unvollständige Testaufbau lieferte nach Inbetriebnahme des astabilen Multivibrators, und der frequenzteilenden Flip-Flops einen sehr schönen Output (siehe9.32). Auf 9.32 gut zu erkennen sind die auf das Minimum eingestellten Flanken des astabilen Multivibrators, sowie die jeweils durch ein Flip-Flop hal- 83
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Projektlabor im Fachgebiet Elektrot
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9.3.2 Standbyerkennung . . . . . .
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1 Einführung Vorwort zum Projektla
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3 Bedienungsanleitung 3.1 Multifunk
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Im Timermodus kann man die Dose im
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3.3 Kontroll-LEDs Nach Einstellen d
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Teil II Die Gruppe 13
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6 Fotos und Namen 6.1 Gruppe 1: Bed
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6.3 Gruppe 3: Stand-By-Erkennung un
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6.5 Gruppe 5: Netzteil und Leistung
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wurden. Alle Überlegungen wurden m
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die Steckdose, aber so ist das halt
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so viel zeit investiert wie für da
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8 Schnittstellen und Busbelegung Nr
Seite 29 und 30:
die Idee auf ein Bussystem mit Adre
Seite 31 und 32: Abbildung 9.2: Platine Kanalplatine
Seite 33 und 34: Moduswahl Abbildung 9.4: Schematic
Seite 35 und 36: Status Abbildung 9.5: Schematic Sta
Seite 37 und 38: Dimmer/Timer Das Blockschaltbild ze
Seite 39 und 40: Sleep-Counter Die beiden Bauteile 4
Seite 41 und 42: Der Zähler zum Einstellen der Time
Seite 43 und 44: AND-Gatters anliegen. Die Inverter
Seite 45 und 46: Abbildung 9.10: Schematic DA-Wandle
Seite 47 und 48: 9.1.2 Die Fernbedienung Mit der Fer
Seite 49 und 50: Abbildung 9.12: Teilschaltung für
Seite 51 und 52: Im folgenden sind noch die Layouts
Seite 53 und 54: Die Tastaturschaltung besteht aus 1
Seite 55 und 56: Abbildung 9.19: Boardoberseite Tast
Seite 57 und 58: Die Versorgungsspannung von 5V bezi
Seite 59 und 60: Abbildung 9.22: Boardunterseite Tas
Seite 61 und 62: Part Value Device Package Sheet C22
Seite 63 und 64: Part Value Device Package Sheet C1-
Seite 65 und 66: IC1 4070N 4070N DIL14 1 IC2 4508N 4
Seite 67 und 68: PL1 10VS 10V 1 PL2-PL3 16VS 16V 3*2
Seite 69 und 70: Part Value Device Package Sheet CLA
Seite 71 und 72: Hier das ursprüngliche Konzept als
Seite 73 und 74: Endgütlige Schaltung Finale Zusamm
Seite 75 und 76: Schaltpläne Es folgt nun der Schal
Seite 77 und 78: Abbildung 9.27: Der auch abschalten
Seite 79 und 80: Probleme Probleme mit den Flip-Flop
Seite 81: Abbildung 9.28: Testaufbau 81
Seite 85 und 86: Abbildung 9.33: Simulation des Sign
Seite 87 und 88: heit den Befehl, die Steckdose wied
Seite 89 und 90: Zusammenfassung Signalweg der Schal
Seite 91 und 92: Abbildung 9.36: Das Platinenlayout
Seite 93 und 94: Hier das ursprüngliche Konzept als
Seite 95 und 96: Es folgt nun der Schaltplan: Die Cl
Seite 97 und 98: denn schnell. Die Fehler kamen soba
Seite 99 und 100: Abbildung 9.41: Beschaltung mit Vor
Seite 101 und 102: Wenn der Kondensator aufgeladen wir
Seite 103 und 104: Im gesamten Schaltplan sind leicht
Seite 105 und 106: Abbildung 9.47: Funktionierende Tes
Seite 107 und 108: Hier die Bestückung: Abbildung 9.4
Seite 109 und 110: Das Top-Layout: Abbildung 9.50: Top
Seite 111 und 112: Abbildung 9.51: Blockschaltbild 111
Seite 113 und 114: Abbildung 9.52: Dimmersteuerung Abb
Seite 115 und 116: C 5 über den Transistor. Durch Var
Seite 117 und 118: Der Dimmer an sich. Berechnungen Sp
Seite 119 und 120: Abbildung 9.61: Eagle Schematic Dim
Seite 121 und 122: Abbildung 9.63: Phasenanschnitt (sc
Seite 123 und 124: Abbildung 9.65: Phasenanschnitt (st
Seite 125 und 126: Triacs und des Diacs im Nulldurchga
Seite 127 und 128: B 1 C 1 C 2 C 3 RECTIFIER-FB32 (Br
Seite 129 und 130: Abbildung 9.69: Originalschaltplan
Seite 131 und 132: Dies führte eine neue Dimensionier
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Die Referenzspannung am 2. OPV R U
Seite 135 und 136:
Abbildung 9.75: 3D-Platine Bestück
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9.4 Gruppe 4: Master und Energie 9.
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Messdiagramme zur Testreihe Übersp
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Bodediagramm des Netzfilters Wir ha
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den Netzfilter verwendet wird. Des
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Abbildung 9.84: Bestückungsplan Ne
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Strommessung Unser “Power-Tower
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Abbildung 9.86: Schaltplan V-A-Mess
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Q 1 : 2N2907A Q 2 : 2N2222A C 1 , C
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chen werden kann, dass man das ausg
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Abbildung 9.90: Schaltplan Masterer
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0, 44mA = 15V − 4, 4V R 6 − 12V
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Abbildung 9.92: Bestückungsplan Ma
Seite 161 und 162:
Abbildung 9.93: Schaltplan des Netz
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Abbildung 9.95: Layout Top des Netz
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des Optokopplers werden nur die Imp
Seite 167 und 168:
9.5.3 Schalten Schalten mit bistabi
Seite 169 und 170:
Die Logik wurde durch Pulldowns, 10
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ler über die 15V-Schiene seine Spa
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Anfang Januar wurde dann endlich ge
Seite 175 und 176:
oben verlötet werden. Besonders di
Seite 177 und 178:
Schalten mit Triacs Idee In dem Lei
Seite 179 und 180:
putt ging, kamen wir schnell zu der
Seite 181 und 182:
Layout & Kühlung Die fertige Schal
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A Widerstandsringtabelle 183
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B Datenblätter 185
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