Chipentwicklung fu127 ur Pixel - Prof. Dr. Norbert Wermes ...

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12 1. Di erentielle Stromlogik Load Load D OUT I 0 Abbildung 1.8: Schaltung eines Latches in differentieller Logik D OUT
1.2. Di erentielle Stromlogik 13 EN D EN OUT EN EN bus bus OUT Abbildung 1.9: Ein Tristate-Bu er (Bustreiber) in di erentieller Logik. Im hochohmigen Ausgangszustand (EN=low) wird der Biasstrom I0 nach Vlo abgeführt, andernfalls auf den Bus geleitet. Die Lasten existieren n<strong>ur</strong> einmal pro Bus und werden daher auch als Busreceiver bezeichnet. I 0 D EN Vlo EN
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Seite 53 und 54: 5.1. Beschreibung der Ladungspumpe
Seite 55 und 56: 5.2. Messungen der Ladungspumpeneig
Seite 57 und 58: 5.2. Messungen der Ladungspumpeneig
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Seite 61 und 62: 6. Zusammenfassung und Ausblick Im
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