Chipentwicklung fu127 ur Pixel - Prof. Dr. Norbert Wermes ...
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1.2. Di erentielle Stromlogik 13<br />
EN<br />
D<br />
EN<br />
OUT<br />
EN<br />
EN<br />
bus bus<br />
OUT<br />
Abbildung 1.9: Ein Tristate-Bu er (Bustreiber) in di erentieller Logik. Im<br />
hochohmigen Ausgangszustand (EN=low) wird der Biasstrom I0 nach Vlo<br />
abgeführt, andernfalls auf den Bus geleitet. Die Lasten existieren n<strong>ur</strong> einmal<br />
pro Bus und werden daher auch als Busreceiver bezeichnet.<br />
I 0<br />
D<br />
EN<br />
Vlo<br />
EN