VHDL Kompakt - CES
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5.1 Anweisungen<br />
wait; Unendlich langes Warten. . . Da ein <strong>VHDL</strong>-process immer aktiv ist, bietet diese<br />
Anweisung am Ende des Prozesses die einzige Möglichkeit ihn quasi anzuhalten.<br />
Dies wird beispielsweise in Testumgebungen oder bei Initialisierungen benutzt, die<br />
nur einmal abgearbeitet werden sollen.<br />
In dem Beispiel wird eine Architektur modelliert, die über zwei Prozesse eine Erzeuger/Verbraucher<br />
Situation simuliert. Über ein einfaches Handshake-Protokoll (zwei<br />
Leitungen, mit je zwei aktiven Zuständen) werden die Prozesse synchronisiert.<br />
Beispiel<br />
entity PRODUCER_CONSUMER is<br />
...<br />
end entity PRODUCER_CONSUMER;<br />
architecture BEHAV of PRODUCER_CONSUMER is<br />
signal PROD: boolean := false; erzeugt Semaphor<br />
signal CONS: boolean := true; verbraucht Semaphor<br />
begin<br />
PROD_P: process Erzeuger<br />
begin<br />
PROD
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