VHDL Kompakt - CES

A. Syntaxbeschreibung
〈architecture body〉
architecture 〈architectureId〉 of 〈entityId〉 is
[ 〈local declarations〉 ]
begin
〈statements〉
end [architecture] [ 〈architectureId〉 ];
〈local declarations〉 ::=
{use 〈...〉 } |
{function 〈...〉 } | {procedure 〈...〉 } |
{type 〈...〉 } | {subtype 〈...〉 } |
{file 〈...〉 } | {alias 〈...〉 } |
{component 〈...〉} | {〈configSpec〉} |
{constant 〈...〉 } |
{signal 〈...〉 }
entity 〈entityId〉 is
...
begin
...
end entity 〈entityId〉;
package 〈packageId〉 is
...
end package 〈packageId〉;
configuration 〈configId〉 of 〈entityId〉 is
...
end configuration 〈configId〉;
〈bLabel〉: block (〈sigList〉) is
...
begin
...
end block 〈bLabel〉;
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architecture 〈archId〉 of 〈entityId〉 is
...
begin
...
end architecture 〈archId〉;
package body 〈packageId〉 is
...
end package body 〈packageId〉;
procedure 〈procId〉 (〈paraList〉) is
...
begin
...
end procedure 〈procId〉;
〈pLabel〉: process (〈sigList〉) is
...
begin
...
end process 〈pLabel〉;