VHDL Kompakt - CES
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A. Syntaxbeschreibung<br />
〈subprogram body〉<br />
function 〈functionId〉 [ 〈parameter declaration〉 ] return 〈typeId〉 is<br />
[ 〈local declarations〉 ]<br />
begin<br />
〈sequential statements〉 mit return<br />
end [function] [ 〈functionId〉 ];<br />
〈parameter declaration〉 ::=<br />
( [ 〈class〉 ] 〈formal list〉 : [in] 〈typeId〉 [:= 〈expression〉 ]{ ;<br />
[ 〈class〉 ] 〈formal list〉 : [in] 〈typeId〉 [:= 〈expression〉 ]} )<br />
〈class〉 ::= constant|signal|file Okjektklasse<br />
procedure 〈procedureId〉 [ 〈parameter declaration〉 ] is<br />
[ 〈local declarations〉 ]<br />
begin<br />
〈sequential statements〉<br />
end [procedure] [ 〈procedureId〉 ];<br />
〈parameter declaration〉 ::=<br />
( [ 〈class〉 ] 〈formal list〉 : [ 〈mode〉 ] 〈typeId〉 [:= 〈expression〉 ]{ ;<br />
[ 〈class〉 ] 〈formal list〉 : [ 〈mode〉 ] 〈typeId〉 [:= 〈expression〉 ]} )<br />
〈class〉 ::= constant|signal|variable|file Okjektklasse<br />
〈mode〉 ::= in|out|inout Wirkungsrichtung<br />
entity 〈entityId〉 is<br />
〈subprogram body〉<br />
begin<br />
...<br />
end entity 〈entityId〉;<br />
package 〈packageId〉 is<br />
...<br />
end package 〈packageId〉;<br />
configuration 〈configId〉 of 〈entityId〉 is<br />
...<br />
end configuration 〈configId〉;<br />
〈bLabel〉: block (〈sigList〉) is<br />
〈subprogram body〉<br />
begin<br />
...<br />
end block 〈bLabel〉;<br />
80<br />
architecture 〈archId〉 of 〈entityId〉 is<br />
〈subprogram body〉<br />
begin<br />
...<br />
end architecture 〈archId〉;<br />
package body 〈packageId〉 is<br />
〈subprogram body〉<br />
end package body 〈packageId〉;<br />
procedure 〈procId〉 (〈paraList〉) is<br />
〈subprogram body〉<br />
begin<br />
...<br />
end procedure 〈procId〉;<br />
〈pLabel〉: process (〈sigList〉) is<br />
〈subprogram body〉<br />
begin<br />
...<br />
end process 〈pLabel〉;