Grundlagen der Digitaltechnik - Ing. H. Heuermann - FH Aachen
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6.3 Current Mode Logik (CML) 101<br />
Beim Bild6.8 ist auf die unterschiedliche Beschaltung zu Bild6.7 zu achten!<br />
Bild 6.8: CML-ODER-Gatter y = x 1 + x 2 : Eingetragene Spannungen als Beispiel für x 1 =<br />
x 2 = 0 und y = 0.<br />
x 2 x 1 y<br />
0 0 0<br />
0 1 1<br />
1 0 1<br />
1 1 1<br />
Tab. 6.5.<br />
Wahrheitstafel ODER
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