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VHDL Kurzbeschreibung

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case statementcase expression isfwhen valuejor val listjval range => sequential statementsg[when others => sequential statements]end case;C CCCCCCCCCCCCCCCCCCCCCCCCCCCCCCCCCCCCCCCCCWentity ENT ispackage PKG ispackage body PKG isbegin.......end ENT;end PKG;end PKG;architecture ARC of ENT isconfiguration CONF of ENT isbegin.......end ARC;end CONF;B: blockP: processprocedure P (...) isbegin.......begin.......?begin.......end block B;end process P;end P;103

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