VHDL Kurzbeschreibung
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Untertyp mit Auosungsfunktionsubtype RESOLVED BIT4 is WIRED OR BIT4;...architecture BEHAVE of TRISTATE issignal ASEL, BSEL: boolean;signal SIGA, SIGB: BIT4;signal SIGS: RESOLVED BIT4;beginSOURCE1: process (ASEL, SIGA)beginSIGS