VHDL Kurzbeschreibung

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10.1.3 Endliche AutomatenFur die <strong>VHDL</strong>-Modellierung endlicher Automaten gibt es die unterschiedlichsten Moglichkeiten,wovon hier exemplarisch eine Methode vorgestellt werden soll, die die beste Kontrolleuber die Syntheseergebnisse verspricht.Die Grundidee hierbei ist, da innerhalb der beschreibenden Architektur die sequentielleLogik (- und -Schaltnetze ) Berechnung des Folgezustandes und der Ausgangsfunktion)und die Zeitglieder in den Ruckkopplungspfaden (-Register ) Synchronisierung derZustandsubergange) in getrennten Prozessen beschrieben werden. Die Unterscheidung desAutomatenmodells nach Mealy- und Moore-Modellierung betrit dabei nur die Codierungdes Prozesses der die Schaltnetze beschreibt.Beispiel: entity MEALY is Mealy-Automatport (X, CLK: in bit;Z: out bit);end;architecture BEHAVIOR of MEALY istype STATE TYPE is (S0, S1, S2);3-Zustandesignal CURRENT STATE: STATE TYPE; aktueller Zustandsignal NEXT STATE: STATE TYPE; FolgezustandbeginCOMBIN: process(CURRENT STATE, X) Proze fur kombinatorische Logikbegincase CURRENT STATE isVerzweigung durch CURRENT STATEwhen S0 =>Z
SYNCH: processProze fur synchrone Elemente (Flipops)beginwait until CLK'event and CLK = '1'; Synchronisation auf VorderankeCURRENT STATE Z
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VHDL KurzbeschreibungA. MaderUniver
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10.1.2 VHDL-Prozesse : : : : : : :
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1.2 Design-ParadigmenDer eigentlich
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Syntax:entity entity name is[generi
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DatenuBei dieser Beschreibung wird
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Ublicherweise wird fur die Simulati
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Integer : Zahlen sind moglichvon ,2
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Nachfolgend werden einige Eigenscha
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Es lassen sich auch Arrays von Arra
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Zugristypen : Wie Zeiger in Program
Seite 21 und 22: Bereichefunction VEC2INT (INVEC: bi
Seite 23 und 24: Bei der Deklaration konnen die Wert
Seite 25 und 26: Da VHDL streng typisiert ist, musse
Seite 27 und 28: 5 Sequentielle BeschreibungenDie ze
Seite 29 und 30: Moglichkeiten fur choicesvalue => s
Seite 31 und 32: Wait : kontrolliert dynamisch die A
Seite 33 und 34: In dem folgenden Beispiel wird ein
Seite 35 und 36: Beispiel: function DECR (X: integer
Seite 37 und 38: 6 SignaleWahrend die VHDL-Elemente
Seite 39 und 40: Aktivierung der Zuweisung :Obwohl S
Seite 41 und 42: Untertyp mit Auosungsfunktionsubtyp
Seite 43 und 44: Beispiel: entity DFLOP is D-Type FF
Seite 45 und 46: Beispiel: process (A, B) sensitivit
Seite 47 und 48: | ist aquivalent zu|architecture ..
Seite 49 und 50: SETRESET---ABABU1! d CXXXXXXXX-! d
Seite 51 und 52: Beispiel:architecture S of COMPARE
Seite 53 und 54: Beispiel: configuration ONE of XR2
Seite 55 und 56: Generische Werte werden bei der Dek
Seite 57 und 58: 9 Libraries und PackagesEin package
Seite 59 und 60: Zusatzliche Libraries und Packages
Seite 61 und 62: { Schranken fur die Flache (area){
Seite 63 und 64: 10.1.1 Behandlung von Beschreibungs
Seite 65 und 66: 10.1.2 VHDL-ProzesseDas entscheiden
Seite 67 und 68: Variablen : Als Zwischenspeicher be
Seite 69 und 70: Latch mit asynchronem Setprocess (S
Seite 71: nur einen Takt : die Benutzung mehr
Seite 75 und 76: ASyntaxbeschreibungAnmerkung:Der An
Seite 77 und 78: A.2 Bibliothekseinheitenentity decl
Seite 79 und 80: package declarationpackage identier
Seite 81 und 82: conguration declarationconfiguratio
Seite 83 und 84: port declarationport (identier list
Seite 85 und 86: subtype declarationsubtype identier
Seite 87 und 88: constant declarationconstant identi
Seite 89 und 90: le declarationfile identier : type
Seite 91 und 92: subprogram declarationprocedure sub
Seite 93 und 94: attribute declarationattribute iden
Seite 95 und 96: A.4 Spezikationenattribute specicat
Seite 97 und 98: disconnection specicationdisconnect
Seite 99 und 100: use clauseuse selected name f, sele
Seite 101 und 102: assertion statementassert condition
Seite 103 und 104: variable assignment statementtarget
Seite 105 und 106: if statementif condition thensequen
Seite 107 und 108: loop statement[loop label:][while c
Seite 109 und 110: exit statementexit [loop label][whe
Seite 111 und 112: null statementnull;C CCCCCCCCCCCCCC
Seite 113 und 114: process statement[label:] process [
Seite 115 und 116: concurrent assertion statement[labe
Seite 117 und 118: component instantiation statementla
Seite 119 und 120: A.8 Vordenierte AttributeAttribut P
Seite 121 und 122: A.9 Reservierte Bezeichnerabs eleme
Seite 123:
Index:=, 79, 80, 84, 85, 87, 100, 1
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