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Facoltà di Ingegneria - Udu Lecce

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PROGRAMMA<br />

Teoria<br />

• ARCHITETTURA DEI CALCOLATORI ore: 1<br />

La struttura gerarchica dei sistemi <strong>di</strong> elaborazione. I livelli <strong>di</strong> un sistema <strong>di</strong> elaborazione.<br />

Instruction Set Architecture. Architettura <strong>di</strong> calcolatore.<br />

• STRUTTURA DEI CALCOLATORI ore: 6<br />

Strutture <strong>di</strong> interconnessione. Struttura a singolo bus. Passaggio <strong>di</strong> controllo del bus.<br />

Struttura interna del bus. Lettura e scrittura in memoria ed unità periferiche. Memory<br />

mapped I/O. Evoluzione dei bus. Bus multipli. Tipi <strong>di</strong> bus.<br />

Struttura dei processori. Il ciclo <strong>di</strong> istruzione. Diagramma <strong>di</strong> stato dell'interpretazione <strong>di</strong><br />

una istruzione. Struttura generale dei processori. Fase fetch. Fasi execute.<br />

Temporizzazione. Unità <strong>di</strong> controllo 'cablata'. Il clock, il contatore tempi e la rete<br />

combinatoria. Funzioni booleane della rete combinatoria della fase fetch. Unità <strong>di</strong><br />

controllo microprogrammata. La temporizzazione nelle unità <strong>di</strong> controllo<br />

microprogrammate. Il formato <strong>di</strong> microistruzione. Deco<strong>di</strong>fica del co<strong>di</strong>ce operativo.<br />

Diagramma a blocchi dell'unità <strong>di</strong> controllo microprogrammata. Unità aritmetica e logica.<br />

• SUPPORTO AL SISTEMA OPERATIVO ore: 6<br />

Elaborazione delle eccezioni e degli interrupt. Diagramma <strong>di</strong> stato per l'elaborazione<br />

delle eccezioni. Determinazione del momento in cui l'eccezione verrà servita. Tipi <strong>di</strong><br />

eccezioni. Interrupt da <strong>di</strong>spositivi <strong>di</strong> I/O. Interrupt maskable e priorità. Trap e fault.<br />

Tracing. Errori <strong>di</strong> bus. Reset. Eccezioni multiple. Riconoscimento della sorgente<br />

dell'interrupt. Vettori <strong>di</strong> eccezioni. Sequenza <strong>di</strong> elaborazione delle eccezioni.<br />

Gestione e protezione della memoria. Mapping fra in<strong>di</strong>rizzi logici ed in<strong>di</strong>rizzi fisici.<br />

Singola area. Aree multiple. Segmentazione. Paginazione. Memoria virtuale.<br />

Paginazione e segmentazione multilivello. Mapping gerarchico. Mapping non<br />

gerarchico. TLB. Scelta della <strong>di</strong>mensione <strong>di</strong> pagina. Superpagine. Il problema dello Ski<br />

Rental.<br />

Protezione. Matrice degli accessi. Restrizioni. Domini gerarchici. DPL, CPL e co<strong>di</strong>ci <strong>di</strong><br />

protezione. Accesso a segmenti <strong>di</strong> co<strong>di</strong>ce <strong>di</strong> anelli più interni. Call gates. Co<strong>di</strong>ce <strong>di</strong> tipo<br />

conforming.<br />

Accesso a risorse con<strong>di</strong>vise. Diagramma <strong>di</strong> stato dei processi. Esclusione mutua e<br />

regioni critiche. Istruzione test and set. In<strong>di</strong>visibilità <strong>di</strong> test and set. Istruzioni atomiche<br />

Read-Update. Istruzioni LL & SC.<br />

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