DIPLOMARBEIT - FG Mikroelektronik, TU Berlin
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Abbildung 80: Hierarchie der Controller- und Prozessor-Einheit (Design ” TIM“) mit Seitenangaben<br />
TIM<br />
HOST<br />
HOST<br />
HOST_ACC HOST_CTRL<br />
CONTROL<br />
CONTROL<br />
TIM_ACCESS<br />
REG_WRITE<br />
REG_WRITE<br />
REG_READ<br />
REG_READ<br />
MEM_ACCESS<br />
MEM_ACCESS<br />
MEM_CYCLES ADDR_CALC BIT_SHIFT BIT_MASK MEM_ADDRES.. GPU_FIFO_R GPU_FIFO_W PIXBLT_PAT..<br />
INTERRUPT<br />
GR_CPU<br />
GR_CPU<br />
GP_CMD<br />
CLIP<br />
CLIP<br />
PIXBLT<br />
PIXBLT<br />
DADR_SPLIT DY_SPLIT SADR_SPLIT SY_SPLIT PIX_TO_BIT AREA_TO_PI..<br />
REG_ALIAS ASYNC_ACT<br />
Technische Universität <strong>Berlin</strong><br />
Institut für <strong>Mikroelektronik</strong><br />
Lukas Bauer<br />
Diplomarbeit<br />
Hochleistungs-Grafikprozessor in Speedchart-VHDL<br />
Anhang D.1<br />
Seite 113
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