DIPLOMARBEIT - FG Mikroelektronik, TU Berlin
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Abbildung 57: Speedchart-Diagramm VIDEO/VRAM/VR ATTR<br />
VR_ATTR<br />
entry<br />
T1<br />
S1<br />
T2<br />
Subdiag Actions of <br />
A: CAS_falling:=’1’<br />
when CAS_itv(0)=’0’ and CAS_old=’1’<br />
else ’0’;<br />
MWE_falling:=’1’<br />
when MWE_itv=’0’ and MWE_old=’1’<br />
else ’0’;<br />
MSC_rising:=’1’<br />
when MSC_itv=’1’ and MSC_old=’0’<br />
else ’0’;<br />
A: CAS_old:=CAS_itv(0); -- replace ’falling<br />
MWE_old:=MWE_itv; -- replace ’falling<br />
MSC_old:=MSC_itv; -- replace ’rising<br />
Technische Universität <strong>Berlin</strong><br />
Institut für <strong>Mikroelektronik</strong><br />
Lukas Bauer<br />
Diplomarbeit<br />
Hochleistungs-Grafikprozessor in Speedchart-VHDL<br />
Anhang C.2<br />
Seite 90
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