DIPLOMARBEIT - FG Mikroelektronik, TU Berlin
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Technische Universität <strong>Berlin</strong><br />
Institut für <strong>Mikroelektronik</strong><br />
Lukas Bauer<br />
HOST_ACC<br />
entry<br />
T2<br />
T3<br />
T4<br />
T8<br />
stdby<br />
Diplomarbeit<br />
Hochleistungs-Grafikprozessor in Speedchart-VHDL<br />
T1<br />
C: HOST_ACTION=1<br />
A: RS_in:=HOST_RS;<br />
AD_in:=HOST_A;<br />
HWE_in:=’0’;<br />
BS_in:=HOST_BS;<br />
T9<br />
write<br />
S2<br />
S3<br />
S4<br />
A: AS_in:=’0’;<br />
A: AD_in:=HOST_D<br />
after 1ns;<br />
-- spdch only<br />
A: DS_in:=’0’;<br />
T6<br />
T10<br />
T12<br />
T11<br />
read<br />
S6<br />
S7<br />
wait_rdy<br />
Abbildung 87: Speedchart-Diagramm TIM/HOST/HOST ACC<br />
C: HOST_ACTION=2<br />
A: RS_in:=HOST_RS;<br />
AD_in:=HOST_A;<br />
HWE_in:=’1’;<br />
BS_in:=HOST_BS;<br />
A: AS_in:=’0’;<br />
A: DS_in:=’0’;<br />
T7<br />
C: RDY_OUT=’0’<br />
A: AS_in:=’1’;<br />
DS_in:=’1’;<br />
HWE_in:=’1’;<br />
AD_in:=hi32;<br />
HOST_ACTION:=0;<br />
Anhang D.2<br />
Seite 117<br />
T5<br />
C: RDY_out=’1’<br />
done
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