DIPLOMARBEIT - FG Mikroelektronik, TU Berlin
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Technische Universität <strong>Berlin</strong><br />
Institut für <strong>Mikroelektronik</strong><br />
Lukas Bauer<br />
Diplomarbeit<br />
Hochleistungs-Grafikprozessor in Speedchart-VHDL<br />
Abbildung 39: Der “Real Time Read Transfer Cycle” [11] wird beim Midline Reload nötig. Die steigende<br />
Flanke des MOE-Signals (DT/OE) bestimmt den Zeitpunkt des Reloads.<br />
Anhang B<br />
Seite 75